编码，隐匿在计算机软硬件背后的语言读书笔记（14）

最新推荐文章于 2022-06-17 00:20:39 发布

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反馈与触发器

触发器分类（设计使用触发器需要考虑到）：逻辑功能和触发方式。为什么需要对事物分类，为了方便归纳使用。
触发方式：边沿触发、电平触发、脉冲触发
逻辑功能：SR触发器、JK触发器、T触发器、D触发器

名词概念

锁存器+触发信号=触发器
触发器（锁存器）有两点。在时钟控制下，可以保持数据，可以写数据
二进制加法完成的电路为逻辑电路
数据的存储和记忆状态的电路是时序电路

触发器（时序电路最基本的构成电路）

为什么需要触发器？

因为电路不仅需要运算，还需要将结果记忆和保存。

什么是触发器？

能将存储1位二进制信号的基本逻辑单元称为触发器

触发器基本功能？

能够存储两个稳定的状态0和1
在触发信号下（相当于事件的概念，动作特点），这时会根据输入信号置0或者1。本来触发器处于稳定的状态，在触发信号作用下，发生Flip-Flop，再次进入稳定状态。

问题1：触发器设计思路（其实就像简单的闭环灯泡电路，形成回路，电路的状态是不变的。再此基础上引出输入。输入都为0 时表示电路与外界连接断开，输入为1时可以改变状态）
在这里插入图片描述
这个电路可以根据原状态稳定存储0或者1，但是没有输入信号。需要增加一个输入信号，使电路既能够存储也能够改变存储的状态。于是改变电路非门换成或非门。

SR锁存器（因为没有触发信号，也就是时钟控制信号）
在这里插入图片描述
VI1和VI2都为0时，与上个电路是一样的。说明可以自行保存存储状态。

R和S表示直接给存储单元置0或置1
Q’ 其实处于亚稳态状态
当S或R置1时，和过去的状态是没关系的。希望存储器能自行保存，也希望它能听话。
当S和R都为1时，Q和Q’都为0。但当S和R置0时，Q和Q’出现竞争，看谁先为1。

问题2：虽然满足了我们存储和写入数据的要求，数据的任何变化都会反应在存储上。还缺少控制信号，控制它是存数据还是写数据
在这里插入图片描述
Clk=0时，后面锁存器处于保持状态
Clk=1时，可以存数据
CLK相当于触发信号，SR的存储听CLK信号
与时钟信号无关的叫异步信号，有关的叫同步信号

问题3：S 和 R 分别表示存0还是存1。S和R都为1是无用的，需要避免。
在这里插入图片描述
问题4：电平触发有缺陷，有一个问题是当时钟信号置位状态时，如果输入一直跳变，输出也跟着变化。信号切回到存储，存储的是之前的瞬间状态，输出状态很难确定，抗干扰能力弱。规定一个时钟周期输出端只变化一次。