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RSS订阅原创 FPGA实现脉冲滤波的几种方法
在PLC和伺服系统中，经常需要对脉冲进行计数以控制电机运行，对于干净的脉冲信号，使用FPGA采集边沿，非常可靠且易于实现，只需要对需采集的信号延迟一拍，再把延迟的信号与原信号做下处理就能得到上升沿或下降沿，下降沿通过取反的原信号与延迟信号相与获得，上升沿通过原信号与取反的延迟信号获得； 而在实际应用中，PLC或伺服系统的应用环境通常都是非常复杂的，各种电磁干扰，不可能有干净的脉冲信...
2020-04-29 21:32:50
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原创 FPGA实现画中画的一种方法
最近事情特别多，一直抽不出多少时间来更新博客，画中画这是很早之前做的一个案例，这里分享出来主要是整理一下思路，也希望能给做相关方面的同行一些参考或是启发； 首先大略说下项目需求，通过MIPI采集两个Sensor过来的视频流，经过一系列处理如中值滤波，去马赛克等处理，视频最终通过HDMI输出时需要呈现PIP(画中画)的方式；进行画中画处理时，可以视为两个sensor...
2020-04-15 22:49:22
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原创 BT.1120协议简介
BT.1120规定了HDTV的接口协议，详细了解BT1120请参考《ITU-R BT.1120-7建议书——高清晰度电视演播室信号数字接口》，目前已更新至第8版，本文资料全部来源于官方文档；容易搞混淆的是BT609和BT1120的关系，类似BT601是SDTV的数据结构，BT656是SDTV的接口定义，BT709是HDTV的数据结构，BT1120是HDTV的接口定义，可看作是BT709的延伸应用；...
2020-04-06 15:32:51
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原创 BT.656协议讲解与解码
BT.656支持不同位数和分辨率的视频，本文以标准分辨率为720*576i 8bit BT.656（4:2:2）YCbCr SDTV 数字视频信号格式讲解协议和解码方法；采集图像的时候使用隔行扫描，每一帧有2个场，一个叫顶场，一个叫底场（有时又称为偶场和奇场），那么顶场就包含其中所有的偶数行，而底场则包含其中所有的奇数行，传输时其完整的帧结构如图所示；奇场和偶场有效行都为288行，每行有1440个...
2020-04-05 15:35:30
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原创 Xilinx MIPI CSI-2 RX核的使用
首先说明一下，Xilinx的MIPI IP都是授权使用的，为了简化MIPI的使用，Xilinx目前推的都是一体化的设计方式，如CSI-2 Receiver Subsystem，CSI-2 Transmitter Subsystem，DSI Transmitter Subsystem，结合了CSI-2，DSI和物理层D-PHY，本文主要描述CSI-2 Receiver Subsystem；CSI-...
2020-03-29 22:23:47
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原创 MIPI的初步认识
MIPI是Mobile Industry Processor Interface的缩写，翻译成中文是移动行业处理器接口，是MIPI联盟发起的为移动应用处理器制定的开放标准和一个规范，因为MIPI通信可靠性好，传输效率高，占用IO接口少，在越多越多的系统中得到应用；尽管MIPI规范包含一系列的接口规范，但目前最成功使用的是CSI-2和DSI，DSI是Display Serial Interf...
2020-03-29 00:03:44
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空空如也
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