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RSS订阅原创 H.264官方手册之帧间预测
只有解码 P和 B类型的宏块时才能调用该过程。该过程的输出为当前宏块的帧间预测采样点，是一个16x16的亮度采样点 pred(Luma)。以及当ChromaArrayType不等于0时输出 pred(Cb)与pred(Cr)如果mb_type为B_Skip或者B_Direct_16x16，mbPartIdx的范围为0~3，否则（mb_type不等于B_Skip或者B_Direct_16x16），mbPartIdx的范围为0到numMbPart (mb_type)-1。
2024-02-16 15:53:36
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原创 除法器原理之恢复余数法
本文全程将以 124除以3 为例进行求商和取模过程的讲解被除数：dividend除数：divisor商：quotient余数：remainder。
2024-01-21 16:57:48
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原创 vc_static spyglass lint cdc rdc check summary
首先不管是lint cdc rdc report,都分成两大部分，一部分report是setup阶段，另一部分report是相应的规则检查。只有setup阶段的error/warning都清理干净，第二部分的报告才有价值。
2023-12-09 15:50:06
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原创 常用知识点记录
出现上面这种提示时说明要删除的文件夹有进程在占用，解决方法如下：第一步：lsof +D xxdirectory查看xxdir这个目录无法删除是因为哪个进程占用第二步：kill -9 PID使用第一步中得到的PID，用kill -9来解除占用。
2023-09-14 14:58:28
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原创 H.264 / MPEG-4 Part 10 White Paper学习记录
在帧内预测模式下，预测宏块是基于之前的编码块和重建块（未被过滤）。在进行编码前，当前块中需要减去预测块P。对于luma(亮度), P可能是4x4的子块 也可能是16x16的宏块。每个4x4的luma 块总共有9种预测模式；16x16的luma块有4种预测模式；4x4的chroma(色度）块只有一种预测模式。
2023-07-15 15:52:55
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原创 modelsim中查找信号是否具有特定取值
searchlog -expr { /test/write_data == 1’b1 } 30000上述命令是使用modelsim时查找信号write_data自30000ps开始第一次为1的时刻注意各个符号之间的空格不要省略，可能会出错。30000为查找的起始时间
2022-02-25 17:00:04
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原创 python基操3_读取excel并写入txt（判断无重复写入）
import openpyxlwb = openpyxl.load_workbook('pin_list.xlsx')sheet = wb.get_sheet_by_name('Sheet2')for i in range(2,25,1): if sheet.cell(row=i,column=2).value == 'O': data = 'input '+sheet.cell(row=i,column=1).value +'\n' print(data
2021-09-01 19:33:58
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原创 python基操2_读取excel输出txt
import openpyxlwb = openpyxl.load_workbook('pin_list.xlsx')#print(wb.get_sheet_names())sheet = wb.get_sheet_by_name('Sheet2')for i in range(2,23,1): if sheet.cell(row=i,column=2).value == 'I/O': with open("test1.txt","a",encoding="utf-8") a
2021-09-01 10:25:17
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原创 python基操1_写入txt文件
# coding=utf-8i = 0for fields in range(64): with open("xx.txt","a") as f: f.write('wire xx_%s_oe;\n%(i)) i = i + 1
2021-09-01 09:15:19
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转载 建立时间与保持时间
1. 定义Setup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求。建立时间(setup time)建立时间是指触发器的时钟信号上升沿到来以前，数据稳定不变的时间。输入信号应提前时钟上升沿（如上升沿 有效）T时间到达芯片，这个T就是建立时间-Setup time。.如不满足setup time,这个数据就不能被这一时钟打入触发器，只有在下一个时钟上升沿，数据才能被打入触发器。用Tsetup或者Tsu表示，也就是说要锁存的数据必须比上升沿早来时间必须大于建立时间。引自 ht
2021-04-22 19:45:17
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转载 锁存器、触发器、寄存器的关联与区别及其相应的verilog描述
1：锁存器、触发器、寄存器的关联与区别首先应该明确锁存器和触发器是由与非门之类的东西构成。尤其是锁存器，虽说数字电路定义含有锁存器或触发器的电路叫时序电路，但锁存器有很多组合逻辑电路的特性。 锁存器（latch） 电平触发的存储单元，数据存储的动作取决于输入时钟（或者使能）信号的电平值，当锁存器处于使能状态时，输出才会随着数据输入发生变化。（简单地说，它有两个输入，分别是一个有效信号EN,一个输入数据信号DATA_IN，它有一个输出Q，它的功能就是在EN有效的时候把DATA_IN的值传给Q，也
2021-04-21 21:25:26
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转载 Verilog中语句执行顺序的理解
转载自这篇博文verilog主要的模块之间都是并行执行的，例如各个always之间 如果你在一个always中要对a赋值，而在另一个always中要使用a的值，这时候就要注意了，两者并行的，处理先后不能确定。 你当前处理的a，是这个时钟被赋值的还是上一时钟被赋值的，意义可能完全不同，这就是并行需要考虑的问题。而在always内部，一般使用了begin…end。这里面的内容都是顺序执行的，比如...
2020-03-16 23:06:42
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原创 FPGA学习总结2（VGA rom的设置）
存储行列颠倒第一个总结来自博文当需要显示大小规格如下图所示高为32bit 宽为224bit的字符时一般可以设置存储字符数据的rom的尺寸大小为位宽32，深度224rom的尺寸如下图所示由于这些字符的像素数据是通过取字模的方式得到的，而且有按列扫描，存储从高位到低位的特质如上图所示，字符的第一列共32位，存在存储器的地址位addr0的地方，第二列存在addr1的地方。所以深度为2...
2020-02-28 20:55:03
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原创 Neo4j的安装及一些报错的解决
基本的安装的步骤见下面的链接链接: link遇到的问题：1启动beo4j时遇到下面的问题。2018-11-04 05:45:24.783+0000 ERROR Failed to start Neo4j: Starting Neo4j failed: Component 'org.neo4j.server.database.LifecycleManagingDatabase@1d05cb...
2018-11-04 14:38:48
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空空如也
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