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RSS订阅原创 手把手带你以数学的角度理解 傅里叶变换以及应用（二）
前言傅里叶分析对于工科大部分的学生来说，那绝对是一场噩梦，那是因为傅里叶变换的公式太复杂了，可能是课本给的推导过程过于官方和严谨，让你视乎看不到一丝理解的希望，本篇和下几篇文章将以高中的三角函数讲起，带去理解傅里叶变换和应用，并验证所得到的表达式是否正确，如果对您有所帮助！喜欢就关注一下吧！续接上篇文章：https://blog.csdn.net/huangshanhu/article/details/115433606四、求周期函数的傅里叶变换求上图周期函数的傅里叶变换解：T=20，
2021-04-06 19:47:28
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原创 手把手带你以数学的角度理解 傅里叶变换以及应用（一）
一、 三角函数的正交性1.1 三角函数系形如：cos0x，sin0x，cos1x，sin1x，cos2x，sin2x，…，cosnx，sinnx这样的三角函数，在【-π，π】上满足正交，即其中任意两个不同的函数之积在【-π，π】上的积分等于0。正交性数学表达式：...
2021-04-05 22:20:52
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原创 基于FPGA的PCIe核系列：FPGA root模式生成工程例子分析（1）
一、 PCIE系统架构1.1 PCIE分层结构PCIE结构1.2 TLP包四种TLP类型。Memory （内存空间操作）IO （IO空间操作）Configuration （配置操作）Message （信息操作）四种类型TLP，如果有需要响应，称为Non-Posted TLP，如果没有需要响应，称为Posted TLP。TLP包类型1.2.1 TLP结构TLP数据格式1.2.2 Header各个字段的含义Header格式...
2021-04-05 15:18:03
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原创 可编程逻辑芯片的“心脏”：FPGA时钟网络（1）
一、时钟网络简介1.1 时钟网络在FPGA中时钟网络是一种布局布线的有限资源（相对而言）互联网络，即在实现布局布线时使用时钟网络让信号能够低延时，同步的到达目标器件。在FPGA中时钟网络资源是有限的，即要合理的使用。时钟网络是一种专用的资源。1.2 为什么使用时钟网络在设计中如要使用逻辑生成的时钟，但是时钟可能存在偏斜，抖动，到达目标器件的时间不同步的，如果使用该时钟会导致设计系统不稳定或者设计失败，所以要进行对时钟的处理，使用时钟网络，避免出现时钟出现抖动偏斜到达目标器件不同步等不可控情况
2021-04-03 09:01:00
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UART干扰算法.zip
2020-08-26
winhex免费版.zip
2020-05-09
DDR3_FIFO设计和调试.doc
2020-03-31
ug586_7Series_MIS.pdf
2020-03-19
srio自回环设计.zip
2020-03-15
空空如也
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