vivado FPGA操作乒乓FIFO
本文调用vivado中ip核的两个standard fifo,通过调整使能信号(wr_en,rd_en)的时序和data_in(与in_1,in_2),data_out(与out_1,out_2)的接通,实现乒乓fifo传输数据流的无缝输入输出,不丢失任何一位数据。 本项目的难点: 1、写入:必须在fifo1停止写入数据之后,下一个时钟上升沿马上把数据写入fifo2,但是由于standard fifo的运行模式,若我们把使能信号简单地分配给统一的状态机,会...
原创
2022-04-13 15:23:28 ·
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