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RSS订阅原创 CRC（循环冗余校验）离线计算
1、前言参考CRC在线计算方式。CRC（循环冗余校验）在线计算_ip33.com开发matlab 版本的CRC离线计算，针对有些离线电脑可以很方便使用。代码开源，方便自定义使用。2、开发工具matlab 2017b3、软件介绍软件界面基于guide，参考CRC（循环冗余校验）在线计算_ip33.com界面设计。 数据输入支持两种模式： 0 --> 读取*.txt文件； ...
2021-12-22 21:39:04
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原创 孔径不确定度与ADC系统性能
《AN-501应用笔记》学习1、孔径不确定度定义 上图显示了采样中的误差是如何导致采样后电压值误差的。而在数学上，采样后电压值误差幅度是由信号函数对时间的导数定义的。导数是当余弦函数等于1时产生最大误差：重新整理后，将dv换为Verr，将dt换为ta（孔径误差），得到孔径不确定度（孔径抖动）定义如下：2、孔径不确定度系统性能的影响：1）增加系统噪声；2）增加被采样信号自身实际相位的不确...
2021-07-31 00:32:43
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原创 github_adi官方例程使用指南
目录1、安装CYGWIN解压缩Cygwin.rar，开始安装。选择git和make安装版本配置启动参数：vivado和SDK2、下载官方参考历程3、例程1、安装CYGWIN解压缩Cygwin.rar，开始安装。选择git和make安装版本在View里选择full在Serach里搜索make，在view里选择4.3-1版本，进行安装。在Serach里搜索git，在view里选择2.29.0-1版本，进行安装。...
2021-07-15 22:57:36
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原创 Vivado将模块封装的两种方法（EDF/EDIF文件和IP核）
写在前面参考文章：https://www.cnblogs.com/kingstacker/p/11508111.html软件版本：Vivado2017.4封装生成.edf，.edif文件1建立工程设置顶层模块将需要封装的模块设置为顶层模块。（shift_bus模块）2、综合待封装模块在设置选项的综合设置中选中打平整个设计，防止别人看到模块层次。设置-mode...
2020-03-29 08:06:29
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原创 vivado2018.2与Questasim10.6c联合仿真
划重点参考文章：https://mp.csdn.net/console/editor/html?not_checkout=1划重点：本文参考了上面这位同学的blog，尝试之后发现还是没有联合起来，最后通过各种尝试，终于解决。其中最主要的原因是：我将VIVADO编译库的存储位置随便定义了一个地方。导致联合仿真时有一些基本库文件没有关联起来。VIVADO与QUESTASIM软件版本对...
2020-03-29 07:48:53
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原创 随机变量的统计量
概率论与随机过程学习笔记学习：1、随机变量的统计量随机变量的N阶矩定义为: N阶矩一阶矩（n=1）是随机变量的均值，二阶矩（n=2）是功率，如果吧随机变量的均值减去，再求N阶矩，就是N阶中心矩。 N阶中心矩二阶中心矩称为方差，方差反应随机变量偏离均值的程度。如果一个随机变量均值为0，那么方差也就等于...
2019-12-02 21:57:01
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转载 BeyondCompare3密钥过期怎么办？不用再找新的密钥，一招帮你搞定！
https://blog.csdn.net/IAlexanderI/article/details/80692409
2019-11-17 11:09:57
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转载 关于SNR和EbN0【转载】
关于snr和Ebno。https://blog.csdn.net/jbb0523/article/details/7841000和https://blog.csdn.net/u013564276/article/details/48730345?utm_source=blogxgwz3
2019-09-05 23:46:20
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原创 搭建适合自己的DDR3仿真平台
之前调试DDR都是下载板子直接观测ChipScope验证。最近需要搭建自己的DDR仿真平台。尝试在IP核里的sim文件为基础，修改添加适合自己的仿真平台。具体过程如下。按照硬件对应的片子生成DDR3 IP，去掉IPcore，添加生成的RTL代码以下主要利用IP核生成的仿真文件搭建适合自己的仿真平台。添加文件到工程DDR3生成的仿真文件夹在“...\ipcor...
2019-08-20 21:59:06
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原创 ise 14.7 XST.exe停止工作
最近在ISE 14.7 上使用srio时， ise在XST时会莫名提示 xst.exe 停止工作。如下图：在有些电脑上，点击“调试程序”，弹出如下界面，选择“NO”，可以继续下去。但是在我的笔记本上，XST直接停止工作，没有任何提示！！！这个问题是在我使用了srio的核之后才出现。去掉srio所有代码，工程回复正常。关于ISE14.7 使用srio_gen2_v1_7问...
2018-11-09 23:13:07
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原创 matlab读取二进制文件
文件格式如下：需将此文件用matlab处理。代码如下：filename=2018.dat'; %%待处理文件路径offset0=0;%%读取数据的初始偏移fid = fopen(filename,'r');fseek(fid, floor(offset0), 'bof');SIG_RFDATA = fread(fid,inf,'bit1');最终读进去的格式是：SI...
2018-11-06 22:06:35
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原创 ADS42LB69使用记录
ADS42LB69数据格式配置为“DDR LVDS Interface Timing”。只需配置 Register 15 为“0X01h”。注意FPGA通过IDDR输入后，正确取出16BIT数据。这里重点记录一个寄存器错误。经实测验证 Register 8 的 DATA FORMAT 选择，手册中Register 8 的D4说明“0”是Twos complement，“1”是Off...
2018-10-23 00:22:29
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原创 求助 ： win7 32位下安装vc++的一个问题？
<br />前几天我在电脑上装上了vc++6.0。但是当我随便无论打开哪个程序<br /> <br /> <br /> <br /> <br />当我ctrl+F7的时候，它怎么就是出现了一个错误：<br /> <br /> <br /> <br />--------------------Configuration: 定积分 - Win32 Debug--------------------<br />Compiling...<br />Error spawning cl.exe<br />定积分.obj
2010-11-06 12:02:00
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CRC_round.zip
2021-12-22
1.1.3--GALILEO SIGNAL GENERATION仿真分析_爱尔兰利莫瑞克大学.pdf
2019-12-29
3--锁相环基本原理.pdf
2019-12-29
ISE_vivado_License.rar
2019-05-12
载噪比宽窄带计算方法
2018-10-23
AD9520_Evaluation_Software_Full_Install
2018-09-13
空空如也
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