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原创 ERROR: [Designutils 12-2331] Pin IOB_X0Y143 is the EMCCLK pin and must be programmed as an input whe

SOLUTION。

2023-05-22 17:56:03 258

原创 三种IP核总线接口比较分析

三种IP核总线接口比较分析(2018-01-13 09:26:44)转载▼标签: 三种IP核总线接口比较分析 原文地址:三种IP核总线接口比较分析作者:Stephen 作者:王智鸣田金文来源:华中科技大学图像识别与人工智能研究所 摘 要 首先介绍了可编程片上系统(SOPC)和IP(Inte11ectual Property)核的基本概念,然后介绍了Altera公司的两种总线标准Avalon和Atlant...

2021-03-15 15:25:21 1130

转载 WDF开发详解

WDF开发详解添加设备:hdwwizKMDF驱动程序框架KMDF 驱动程序框架由对象和事件回调例程构成。KMDF 框架中所有的事物都由对象表示,各种事件处理都由事件回调例程来完成。学习KMDF编程,主要是学习 KMDF 的各种对象、对象函数和时间回调函数的编程。一、1.KMDF 对像为了实现基于对象的技术,微软精心设计了对象模型并进行了封装,提供了属性方法和事件。无论是内核模式的驱动程序还是用户模式的驱动程序,都采用同一套对象模型构建,采用同一个基础承载。1...

2020-11-13 16:04:26 2545

原创 PDF阅读器关闭“使用手型工具阅读文章”功能

1、问题描述某些PDF文件打开时,光标显示的手型工具里面有个箭头,一点击鼠标左键,就跳转到下一页了。给阅读带来很多不便。2、原因因为这类PDF文档中带有“文章”(article),而PDF阅读器默认开启“使用手型工具阅读文章”功能。这一功能使得手型工具中出现箭头,并导致上述现象。普通的没有文章的PDF文件,打开后不会出现这种现象。3、解决方法(1)确认 文档中含有“文章”。...

2019-09-07 16:06:40 2831

原创 使用JTAG口烧录配置FLASH

使用JTAG口烧录配置FLASH一、概述本文提供一种使用JTAG烧录配置FLASH的方式,用来实现传统AS烧录配置FLASH的功能,适用于ALTERA系列FPGA二、基本思路将JTAG用来配置FPGA芯片的.sof文件,使用Quartus自带文件转换工具转换成.jic文件,再使用JTAG模式进行常规烧录即可三、转换流程(1)在Quartus...

2019-09-04 15:41:34 4252

原创 在Quartus中如何使用TCL脚本文件配制管脚

在Quartus中如何使用TCL脚本文件配制管脚quartus软件分配管脚的方法有两种,一是选择菜单“assignments->pins”进入管脚分配视图手动分配;第二种方法是利用tcl脚本文件自动分配。这里我来介绍第二种方法。1.生成tcl文件,按图例顺序操作其中TclScriptFilenam...

2019-08-14 15:04:18 1203

原创 quartus 使用技巧

quartus 使用技巧[设置上拉、生成网表等]引言:工欲善其事必先利其器    在fpga学习中,熟悉一个工具的使用是很有必要的,可以加快开发进度或者帮助我们更好的定位问题。本文总结一些quaruts的常用技巧以供大家参考,不是非常全面,如有更好的技巧,请留言讨论。  使用版本:quartus prime standard17.1 (win 10建议装15.0版本以上的,因...

2019-06-28 16:28:57 4240 1

原创 DDR2 PCB设计规则

采用单片16bit,1Gb内存颗粒,参考型号为MT47H64M16(1Gb) 16bit DDR2内存芯片管脚布局图DDR2与FPGA的信号连接关系如下表(采用单端DQS信号):DDR2 and FPGA pinout table No. DDR2 Signal 说明 DDR2 Pin...

2019-04-18 10:32:55 1911 1

转载 ERROR:Place:866 - Not enough valid sites to place the following IOBs: IO Standard: Name = LVC (20

在编译使用了DDR3 IP核 在进行map时出现了下面的错误:ERROR:Place:866 - Not enough valid sites to place the following IOBs:   IO Standard: Name = LVCMOS25, VREF = NR, VCCO = 2.50, TERM = NONE, DIR =   BIDIR, DRIVE_STR...

2018-12-04 14:39:17 2312

转载 ISE中的chipscope使用教程

一、软件与硬件平台       软件平台:    操作系统:Windows 8.1    开发套件:ISE14.7       硬件平台:              FPGA型号:XC6SLX45-CSG324二、ChipScope介绍  ChipScope是Xilinx提供的一个校验FPGA设计的工具。它的本质是一个虚拟的逻辑分析仪,能调用FPGA内部的逻辑资源对代码...

2018-11-26 15:22:47 6379

转载 Xilinx FPGA 普通IO作为PLL时钟输入

普通IO不能直接作PLL的时钟输入,专用时钟管脚可以;普通IO可以通过BUFG再连到PLL的时钟输入上,但要修改PLL的设置 input clk的选项中要选择"No Buffer";具体内部布局分配可以通过 Xilinx的FPGA Editor来查看,ZYNQ的时钟管理也和之前的片子略有不同,之后在另一篇介绍,相关文档 <ug472_7Series_Clocking.pdf&gt...

2018-11-23 18:00:31 5122

Transceiver_Basics.pdf

Transceiver_Basics.pdf intel内部培训资料,对于熟悉altera fpga的高速收发器很有帮助

2020-09-28

External_Memory_Interface_for_Cyclone_V_device.pdf

External Memory Interfaces intel内部培训资料,对学习altera fpga的ddr IP核很有帮助

2020-09-28

RapidIO_Introduction.pdf

RapidIO Introduction intel内部培训资料,对学习altera fpga的rapidio IP核很有帮助

2020-09-28

PCIe Protocol and AII HIP Feature introduction.pdf

PCIe Architecture and Protocol Overview intel内部培训资料,对学习fpga的pcie IP核很有帮助

2020-09-28

Quartus II Design Series_Timing_9_0_v1

Quartus II software Design Series:Timing analysis 对于altera fpga的时序分析很有帮助,

2020-09-28

PCI Express 系统体系结构

我以“浅谈”开始以下的文字,因为 PCIe 规范博大足使天下无书。正如大家所知,我之前写过一本《PCI Experss 体系结构导读》,每次重温这本书籍时,总是遗憾着书中出现的错误。纸质的图书一旦出现问题,便很难有更改的余地。这一次我们不会再有这些遗憾。

2020-09-28

Windows Driver Kits 教程

Windows Driver Kits 教程 本教程是针对于初学者来的有点难不过了可做为入门教程看一下

2020-09-28

ARM Architecture Reference Manual.pdf

Samsung Electronics Co. Ltd. (“Samsung”) reserves the right to make changes to the information in this publication at any time without prior notice. All information provided is for reference purpose only. Samsung assumes no responsibility for possible errors or omissions, or for any consequences resulting from the use of the information contained herein. This publication on its own does not convey any license, either express or implied, relating to any Samsung and/or third-party products, under the intellectual property rights of Samsung and/or any third parties.

2019-09-04

4.网络设备驱动.zip

NAPI 是 Linux 上采用的一种提高网络处理效率的技术,它的核心概念就是不采用中断的方式读取数据,而代之以首先采用中断唤醒数据接收的服务程序,然后 POLL 的方法来轮询数据,(类似于底半(bottom-half)处理模式);从我们在实验中所得到的数据来看,在随着网络的接收速度的增加,NIC 触发的中断能做到不断减少,目前 NAPI 技术已经在网卡驱动层和网络层得到了广泛的应用,驱动层次上已经有 E1000 系列网卡,RTL8139 系列网卡,3c50X 系列等主流的网络适配器都采用了这个技术,而在网络层次上,NAPI 技术已经完全被应用到了著名的 netif_rx 函数中间,并且提供了专门的 POLL 方法--process_backlog 来处理轮询的方法;根据实验数据表明采用NAPI技术可以大大改善短长度数据包接收的效率,减少中断触发的时间;由于 RTL8139CP 是一种应用比较广泛的网络适配器,所以本文以其为例,说明了NAPI技术在网络适配器上的应用和基本原理。 但是 NAPI 存在一些比较严重的缺陷:而对于上层的应用程序而言,系统不能在每个数据包接收到的时候都可以及时地去处理它,而且随着传输速度增加,累计的数据包将会耗费大量的内存,经过实验表明在 Linux 平台上这个问题会比在 FreeBSD 上要严重一些;另外采用 NAPI 所造成的另外一个问题是对于大的数据包处理比较困难,原因是大的数据包传送到网络层上的时候耗费的时间比短数据包长很多(即使是采用 DMA 方式),所以正如前面所说的那样,NAPI 技术适用于对高速率的短长度数据包的处理,在本文的末尾提出了 NAPI 的改善方法,和实验数据。

2019-09-04

VMWare网络设置.txt

<--虚拟网络0--&gt;物理有线网卡 <---&gt; internet eth0 <--ubuntu--&gt; 网络适配器(虚拟网卡1) <--虚拟网络1--&gt; USB有线网卡 <---&gt; 板子

2019-09-04

TimeQuese_Lab.rar

1、本例程为Altera官方给的一个时序分析的例程,本例程的详细讲解见“通向FPGA之路---七天玩转Altera之时序篇V1.0”文档的87~98页; 2、大家做这个实验之前建议先把里面的.sdc文件给删掉,从头还是做,开始分析; 3、建议先有了一定理论基础再去做这个实验,做的过程中去理解;

2019-09-04

smdesign.pdf

One of the strengths of Synplify is the Finite State Machine compiler. This is a powerful feature that not only has the ability to automatically detect state machines in the source code, and implement them with either sequential, gray, or one-hot encoding. But also perform a reachability analysis to determine all the states that could possibly be reached, and optimize away all states and transition logic that can not be reached. Thus, producing a highly optimal final implementation of the state machine.

2019-09-04

空空如也

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