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原创 [无法使用sudo]:sudo: /usr/bin/sudo must be owned by uid 0 and have the setuid bit set
打开新终端,用其他用户登陆后,再次尝试sudo su。可以切换到root,修复完成。手头:有root账号最好。OS: 银河麒麟V10。
2024-03-25 11:59:35 580
原创 【USTC】verilog 习题练习 46-50
题目描述在实际应用中,我们经常需要对某个信号的边沿进行检测,并以此作为后续动作的触发信号(例如电脑键盘的某个按键被按下或者被松开,在电路中则对应的是电平的变化)。设计一个电路,包含clk信号、1bit输入信号in和1bit输出信号out,当in信号从0变为1时(相对于clk,该信号变化频率很慢),out信号在in信号上升沿附近输出1个时钟周期的高电平脉冲,其余时刻都为0,如下图所示。
2024-01-24 15:45:45 683
原创 【USTC】verilog 习题练习 41-45
题目描述在时序逻辑电路中,敏感变量不但可以是触发信号的上升沿(posedge),也可以是下降沿(negedge),试创建 8bit 位宽的寄存器,所有 DFF 都应该由 clk 的下降沿(负边缘)触发。同时采用高电平有效的同步复位方式,复位值为0x34而不是零。输入格式输入信号 clk,时钟信号。输入信号 reset,复位信号,高电平有效(复位)。输入信号 d,位宽 8bit,任意数据信号。输出格式。
2024-01-23 14:59:12 584
原创 【USTC】verilog 习题练习 36-40
题目描述Verilog中有一个跟C语言中类似的三目条件运算符(?: ),其语法格式为:(condition?该表达式可以用于为其它信号赋值,例如:signal = condition?该语句等同于:因涉及到3个操作数,并且能实现条件运算的功能,因此称为三目条件运算符。下面是几个使用该运算符的例子:(0?3 : 5) // 条件为假,因此表达式的值为5(sel?b : a) // 二选一选择器。
2024-01-22 14:43:37 1346
原创 【USTC】verilog 习题练习 31-35
题目描述语法正确的代码并不一定能产生功能正常的电路,一般来说都是因为不小心引入了锁存器造成的。如上述例子所示,除了指定的情况外(),还有一些其它情况,这时会发生什么?在 verilog 中,其结果就是保持不变,这意味着要记住当前状态,从而产生了锁存。为消除锁存器,我们应当使组合逻辑过程块中的条件完备,输入格式输入信号 cpu_overheated, 位宽 1bit,控制 shut_off_computer 信号。输入信号 arrived, 位宽 1bit,控制 keep_driving 信号。
2024-01-22 13:55:46 936
原创 【USTC】verilog 习题练习 26-30
前例中的加法器成为串行进位加法器,只有等前一级的加法器运算结束产生进位位之后,下一级加法器才能利用进位位进行计算,因此电路延时会随加法器串联级数的增加而线性增加,这使得电路计算速度大大降低。设每一级全加器的延时为t,则32bit加法器的延时则为:32t。
2024-01-18 14:57:08 945
原创 【USTC】verilog 习题练习 21-25
题目描述创建一 verilog 电路,实现对模块 mod_a 基于端口名称的实例化,如下图所示:输入格式输入信号 a, b, c, d,位宽 1bit。输出格式输出信号 out1, out2,位宽 1bit。
2024-01-17 17:23:03 1189
原创 【USTC】verilog 习题练习 16-20
16 向量翻转题目描述创建verilog电路,将8bit的输入信号按bit翻转,并输出到输出端口,如下图所示:输入格式8 bit in输出格式8 bit out, 为in的向量翻转17 复制算子题目描述复制算子是拼接算子的一种特殊情况,如a={b,b,b,b,b,b}便可以写成a={6{b}}的形式。复制算子的格式为:{num{vector}},其中num必须为常量。创建一verilog电路,将一个8bit位宽的输入信号进行符号位扩展,并通过32bit的输出端口输出,如下图所示输入格式。
2024-01-17 16:24:42 918
原创 【USTC】verilog 习题练习 11-15
{4'ha, 4'd10} 等同于 8'b10101010 // 4'ha and 4'd10 are both 4'b1010 in binary。向量拼接时,每个信号都需要有明确的位宽,这样拼接后的信号才会有明确的位宽。例如,{1,2,3}就是非法的,因为无法确定各信号的位宽,语法检查时会报错。输出信号 out_hi,位宽 8bit,为输入信号的高 8 位。输出信号 out_lo,位宽 8bit,为输入信号的低 8 位。6个5位宽的输入信号a,b,c,d,e,f。
2024-01-17 16:21:30 931
原创 【USTC】verilog 习题练习 6-10
之前的verilog模块结构都比较简单,输出信号可直接用输入信号的逻辑表达式表示出来,模块功能稍微复杂时,一般都会用到中间信号,以下图为例,输入信号in经过两个非门后输出到out端口,为了在verilog模块中表示两个非门中间的这跟信号,需要将其定义为线网型(wire)信号,此处我们命名为not_in。创建一verilog模块,具有一个3bit位宽的输入向量信号,然后将其输出到3bit位宽的输出向量信号,同时再分别输出到3个1bit位宽的输出信号,如下图所示。1个3bit位宽的向量信号vec。
2024-01-17 15:47:25 386
原创 【USTC】verilog 习题练习1-5
wire 是 Verilog 的关键字,用于表征信号类型的,其含义是线网。wire 可理解为物理连线,但又有所不同,因为 Verilog 中的 wire 是有方向的。请使用 assign 语句将代码补充完整,使其实现上述电路图的功能。创建一个名为top_module的Verilog模块,实现非门的功能。请使用assign语句将代码补充完整,使其实现上述电路图的功能。2编写 Verilog 代码,使电路输出信号0。
2024-01-17 15:33:00 589
原创 书生·浦语大模型全链路开源体系-Lesson1
InternLM 是在过万亿 token 数据上训练的多语千亿参数基座模型。通过多阶段的渐进式训练,InternLM 基座模型具有较高的知识水平,在中英文阅读理解、推理任务等需要较强思维能力的场景下性能优秀,在多种面向人类设计的综合性考试中表现突出。在此基础上,通过高质量的人类标注对话数据结合 RLHF 等技术,使得 InternLM 可以在与人类对话时响应复杂指令,并且表现出符合人类道德与价值观的回复。
2024-01-05 13:18:12 393
原创 【腾讯云 HAI域探秘】使用HAI+ChatGLM-6B复刻《完蛋,我被大模型包围了》
利用腾讯HAI创建ChatGLM-6B服务端,并复刻《完蛋,我被LLM包围了》小游戏
2023-11-21 13:30:06 418 1
原创 【腾讯云 HAI域探秘】利用HAI轻松拿捏AI作画-基于腾讯云CloudStudio和HAI
高性能应用服务 HAI:澎湃算力,即开即用。以应用为中心,匹配GPU云算力资源,助力中小企业及开发者快速部署LLM、AI作画、数据科学等高性能应用。是为开发者量身打造的澎湃算力平台。无需复杂配置,便可享受即开即用的GPU云服务体验。在HAI中,根据应用智能匹配并推选出最适合的GPU算力资源,以确保您在数据科学、LLM、AI作画等高性能应用中获得最佳性价比。本次实验主要是引导大家如何使用高性能应用服务 HAI部署 StableDiffusion 运行环境轻松拿捏AI作画,开箱即用,可以快速上手;
2023-10-16 09:29:27 363
原创 银河麒麟V10安装深信服VPN无法打开解决办法
台式机,X86的CPU,为适配国产化,装了达梦、东方通等。为方便远程,需要装深信服,找银河麒麟对接人员拿到安装包,分别是X86和X64两个版本。本机是X64版本,故安装X64版本包,银河麒麟居然是ubuntu的内核,所以用dpkg安装即可。可是却无法打开,没反应。故用命令行打开。却报错。
2023-10-10 15:10:32 3982 5
原创 [腾讯云 Cloud studio 实战训练营] 使用Cloud Studio快速构建React完成点餐H5页面还原
Cloud Studio 进行云编程
2023-08-04 11:19:12 131
原创 报错:mvpartially initialized module ‘cv2‘ has no attribute ‘_registerMatType‘ 解决
‘cv2‘ has no attribute ‘_registerMatType‘ 解决
2022-10-19 13:00:15 1265
原创 Windows安装arm64架构的麒麟V10
一、下载QEMU二、下载麒麟V10桌面版三、安装QEMU 安装的时候注意最好不要放在Program Files目录下,后面运行命令行会因为空格,需要特殊处理。 具体QEMU的版本,我用了最新的qemu-w64-setup-20210825.exe四、创建镜像文件 命令很简单:qemu-img create d:\Kylin\KylinDesktopV10.img 60G五、安装镜像 主要是bios文件的选择: 1 ...
2022-02-09 08:53:07 3494
原创 electron 全局安装 更换国内源
npm config set registry=https://registry.npm.taobao.orgnpm config set sass_binary_site=https://npm.taobao.org/mirrors/node-sass/npm config set ELECTRON_MIRROR=https://npm.taobao.org/mirrors/electron/npm install -g electron
2022-01-26 22:37:33 3104
原创 electron报错:Uncaught TypeError: Cannot read property ‘BrowserWindow‘ of undefined
electron 版本16+使用remote模块时出现问题,代码如下:const BrowserWindow = require('electron').remote.BrowserWindow;报错:Uncaught TypeError: Cannot read property 'BrowserWindow' of undefined解决方法:1、安装remote:npm install --save @electron/remote2、demo2.js:3、
2022-01-25 17:50:36 929
原创 Uncaught ReferenceError: require is not defined
当我们使用electron的时候,想要使用nodejs以及第三方的时候出现Uncaught ReferenceError: require is not defined,这种问题的时候,也许并不是我们的问题而是少了配置。也可能是版本的问题。而我们只需要再加一个配置,这个错误提示就会消失,补充:nodeIntegration Boolean (可选) - 是否启用Node integration. 默认值为 false.contextIsolation Boolean (可选) - 是否在
2022-01-25 17:47:13 1278
原创 Uibot中级实践题-动态标签输入框
Uibot的中级实践,拿到的第一个题目是动态标签输入框。在A和B框内输入2句话。鼠标点击目标那里是A,我试了很多次,目前这样不行然后改成如下,主要是 name 那里用 输入框标签数组[i].可是ctrl那里的Array删掉或者不删,都不行。经过测试,还是不行。不知道到底该如何填才好,规定了一条语句,没有好的办法。键盘输入那里是B用户数据[i]简单明了。只要在前面多输出点结果,就知道该如何填了。...
2022-01-24 23:37:12 1835 3
原创 Dart关于继承中构造函数一两事
Dart关于父类子类中构造函数的一些事情Dart中,类的重载是一个小特点,不允许同名的构造函数。放到继承中,一开始就出现点问题。比如如下代码:class Animal { int age; //构造函数 Animal() {} Animal.fromAge(int age) { this.age = age; } void eating() { print("在吃东西"); }}Animal中,定义了无参构造函数,那么带参数构造函数,就只
2020-10-15 16:52:29 976
原创 Rust 常见问题之一:Blocking waiting for file lock on package cache
这里写自定义目录标题Rust学习Rust学习今天开始学习Rust,根据官网步骤,安装,Rust+vs code.前面的测试都还好,到了cargo build 这一步,好慢。果断更换国内源,一看清华的源更新的及时,换上后。cargo build 一直提示Blocking waiting for file lock on package cache。不知道为什么。查了后才知道,在cargo文件夹下面,.package_cache被加锁阻塞解决方法:删除.package_cache文件重新进入v
2020-07-27 22:52:23 17968
斯坦福大学:2024年人工智能(AI)指数报告
2024-04-17
Hello 算法 C++ 语言版
2023-10-10
The C++ Standard Library of the current C++23 standard
2023-10-10
Nginx模块开发指南使用C11和Boost.pdf
2020-01-29
空空如也
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