子墨祭-CSDN博客

原创 Xilinx平台SRIO介绍（汇总篇）

用最简单直白的语言记录复杂的FPGA设计。——FPGA大叔·沃自己硕得

2021-11-29 20:21:17 25411 9

原创 Xilinx FPGA平台GTX简易使用教程（汇总篇）

Xilinx平台GTX简易使用教程，先“知其然”，慢慢再研究“所以然”。

2021-11-21 16:04:25 30202 13

原创 Xilinx FPGA平台DDR3设计保姆式教程（汇总篇）——看这一篇就够了

鉴于笔者最初接触DDR3时，被MIG那一堆信号搞得一脸懵逼，网上各种查资料的艰难回忆，决定借鉴大佬们的经验结合笔者自己的理解，整理一篇DDR3设计指南，通俗易懂，2小时速成！

2021-11-07 14:56:43 29209 15

注：计算机安全领域中的"use-after-free"漏洞是一种常见的内存安全问题，指的是在释放（free）了某块内存后，程序继续使用了已释放的内存区域，可能导致严重的安全问题。当响应ReadClean时，使用Snoop Filter来跟踪请求者缓存状态的Home，不能基于响应请求者的状态降低Snoop Filter中缓存行的状态。在读事务中单独返回数据和响应时，TagOp字段仅在Data-only消息中适用，在Non-data响应消息中不适用，必须设置为零。Clean,Dirty的缓存行都是有效的。

2024-04-08 21:51:29 873

原创【Verilog】工业级RTL代码风格推荐

1.使用标准 DFF 模块例化、生成寄存器。2.推荐使用Verilog中的 assign语法替代if-else 和case语法。

2024-04-07 19:45:21 1362

原创低功耗设计

RTL级低功耗设计

2024-03-19 20:34:49 783

原创【SystemVerilog】结构体真是太好用了~

结构体是可以通过模块接口进行传递。

2024-03-15 22:01:30 618

原创【CHI】Ordering保序

CHI保序

2023-11-21 00:40:46 425 1

原创【CHI】Transaction structure

【CHI-F】Transaction structure

2023-10-26 22:04:29 523

原创【CMN】Power management

PM：对HN-F内部RAM（SLC0,SLC1,SF）的不同部分使能/禁用。

2023-10-26 20:50:06 366

原创【CHI】CHI协议，transaction事务汇总

CHI给你制定了很多种（尽可能覆盖完全）场景及事务，你需要去了解，去认可，然后遵循，这就是协议。

2023-10-21 22:24:16 2028

原创【CMN】Components组件汇总

CMN的组件介绍

2023-10-20 08:15:00 837

原创计算机组成与设计的一些概念扫盲

计算机知识扫盲。

2023-10-09 13:25:59 176

原创计算机体系结构中的8个伟大思想

时至今日，架构师在设计新处理器时仍会延续采用这些思想。

2023-10-09 12:38:17 305

原创【ARM】（1）架构简介

ARM内核与架构、演进历史、ARMv8基础知识

2023-10-06 22:52:03 2512 1

原创【FPGA项目】图像采集及显示（3）总结

总结一下，顺便聊聊项目中常用的一些调试手段。

2023-09-26 08:45:00 690

原创【FPGA项目】图像采集及显示（2）详细设计方案

上文描述了系统框图，本篇则对各个模块进行详细描述

2023-09-26 07:15:00 975

原创片上网络（2）拓扑结构

片上网络的拓扑(topology)确定了网络中节点和通道之间的物理布局和连接。拓扑对网络的整体成本效率(cost-performance) 有相当重要的影响。

2023-09-19 08:45:00 734

原创片上网络（1）概述

片上网络正迅速取代总线和矩阵开关，成为多核芯片中普遍存在的通信结构。

2023-09-15 07:00:00 363

原创【FPGA项目】进阶版沙盘演练——报文收发（报文处理、CDC、CRC）

一个实际报文收发可能会遇到的一些处理：报文处理、握手与反压、跨时钟域处理CDC、CRC校验

2023-09-14 23:30:50 913 6

原创【FPGA项目】沙盘演练——基础版报文收发

用简单的例子带大家了解数字逻辑设计的一些基本概念

2023-09-03 10:09:57 1795 4

原创【FPGA项目】第1个项目，来点个灯吧~

来点个灯吧，照亮FPGA的学习之路。

2023-09-02 09:59:14 567 2

原创【CHI】（十四）Link Handshake

本节介绍了链接层信用证（L-Credit）机制。

2023-08-26 23:31:48 700

原创【CHI】（十三）链路层

This chapter describes the Link layer that provides a streamlined mechanism for packet-based communication between nodes and the interconnect across links.

2023-08-22 00:10:45 1157

转载 ARM Power Management

低功耗对ARM系统来说是非常重要的设计约束。

2023-08-15 18:34:44 276

原创【CHI】（三）网络层

网络层负责确定目标节点的NodeID。

2023-08-15 06:30:00 605

原创【CHI】（一）基础概念

基于CHI issueF，CHI基础概念介绍

2023-08-09 06:00:00 1318 2

原创关于“为爱发电”的一些说明~~

专栏教学资料+工程文件

2023-08-07 22:04:24 1372 18

原创【CHI】架构介绍

Learn the architecture - Introducing AMBA CHI

2023-08-06 16:11:55 3277

原创【CHI】（六）独占访问

AMBA®5 CHI Architecture Specification IssueF

2023-08-05 23:28:33 481 3

原创【GIC】处理中断

Handling Interrupts

2023-02-08 18:00:04 1776 1

原创【GIC】配置GIC

Configuring the GIC

2023-02-07 22:10:35 1041

转载总线一致性：高性能SoC核心技术

Coherent Bus

2023-01-31 22:41:48 1432

原创【GIC】GICv3 基本规则

GICv3 fundamentals

2023-01-31 22:27:19 1199 3

转载【GIC】一文看懂GICv3

Generic Interrupt Controller

2023-01-07 10:10:22 2633

原创【STA】（2）概念

静态时序分析相关概念介绍。

2022-12-20 06:30:00 1897 1

原创【STA】（1）引言

STA(Static Timing Analysis)：静态时序分析

2022-11-28 06:15:00 1258 1

原创【通用设计方法】之接收异常保护

我胡汉三又回来了~

2022-11-24 23:58:13 738

原创【转】存储器结构、cache、DMA架构分析

DMA

2022-06-27 23:00:34 1498

（精选）SoC设计方法与实现(郭炜)课件.zip

SoC设计方法与实现(郭炜)课件

2023-11-02

（精选）CHI协议，transaction事务汇总

CHI协议，transaction事务汇总： 1.部分事务分为ptl/full ，这里不做区分。 2.事务名基本可以“望文生义”，也就是我们代码所推荐的“命名即注释”。 3.部分事务的行为并不完全确定，个人推测。 4.针对request type，response type的待补充。 5.若有遗漏/错误，欢迎补充/指正。 6.更多内容，参见《AMBA 5 CHI Architecture Specification》。

2023-10-21

（特权同学）FPGA图像采集及显示工程文件

2023-09-26

（精选）FPGA接口篇配套学习工程（DDR3、GTX、Aurora、SRIO、LVDS）

FPGA接口篇配套学习工程（DDR3、GTX、Aurora、SRIO、LVDS）版本：vivado2018.3

2023-09-14

（精选）FPGA项目沙盘演练-基础版报文收发（vivado2017.4）

（详细项目内容请看对应博客正文，本资源为对应项目工程，含仿真文件）一、项目要求 1.输入报文长度64~2048字节； 2.输入报文之间最小间隔为两拍； 3.输出报文的前两拍添加16bit报文长度信息；第1拍为报文长度高8位；第2拍为报文长度低8位；第3拍开始为输入报文；二、项目方案 1. 要求输出报文，且报文输出在报文长度输出之后，所以需要先对输入报文进行缓存，根据输入报文的位宽和长度范围，此处选择合适的同步FIFO即可；（如果是IC，那么就需要自己写FIFO，可以参考本博客的FIFO介绍）这里项目提出了第1个要求，掌握FIFO的使用。 2. 要求输出报文长度，所以需要对输入报文长度进行计数，并将其缓存；此处有坑，若只用寄存器对长度进行缓存，存在被后续报文长度覆盖的风险，故需要第2个FIFO对报文长度进行缓存。 3. 要求先输出报文长度然后紧跟着输出报文，此处需要对时序进行设计，需要掌握FIFO的读写时序，需要理解fpga的时钟沿采样。理解：时钟沿采样及数据下一时钟沿变化。

2023-09-06

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学习项目mod-qdr

gtx测试模块仿真tb文件

gtx测试模块top文件

gtx数据发送模块packet-send

gtx数据包接收模块packet-recv

高速接口字节对齐模块代码

LVDS sim文件-1

LVDS TX数据源产生

srio测试top文件

时钟复位模块clk-rst

模拟camera产生虚拟图像数据：灰度条

Verilog加法器设计

ddr3-cache的源代码

LCD图像显示驱动模块

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Verilog语法进阶

FPGA的visio组件.rar

画时序图的工具TimingDesigner_v9.2_win.rar

csdn被java承包了吗[face]emoji:028.png[/face]