emacs ido mode

Using IDO

To switch between buffers, press “C-x b”, then:

  • type some characters appearing in the buffer name, RET to visit the buffer in the front the list.
  • use C-s (next) or C-r (previous) to move through the list.
  • [Tab] display possible completion in a buffer (or visit the buffer if there is only one possible completion).
  • use C-f to fall back to find file (without ido-mode) or C-b to fall back to switch to buffer (without ido-mode).

To find a file, press “C-x C-f”.

  • type some characters appearing in the file name, RET to choose the file or directory in the front of the list.
  • C-s (next) or C-r (previous) to move through the list.
  • [Tab] - display possible completion in a buffer (or open the file or go down the directory if there is only one possible completion).
  • RET - type to go down inside the directory in front of the list.
  • [backspace] - go up to the parent directory.
  • // - go to the root directory.
  • ~/ - go to the home directory.
  • C-f - to go back temporarily to the normal find-file.
  • C-d - enter Dired for this directory (used to be C-x C-d in older versions)
  • C-j - create a new file named with the text you entered (note: this is needed if the text you entered matches an existing file, because RET would open the existing one)
Emacs Verilog Mode是一种用于在Emacs编辑器中编辑Verilog HDL(Hardware Description Language)的模式。它提供了丰富的功能和快捷键,使Verilog代码的编写和调试更加方便和高效。 Emacs Verilog Mode具有以下主要特点: 1. 语法高亮显示:Verilog代码的不同部分会使用不同的颜色进行区分,以便更容易地阅读和理解代码。 2. 自动缩进:在编写代码时,程序会自动进行缩进,以便更清晰地展示代码的层次结构。 3. 代码折叠:Emacs Verilog Mode允许代码的折叠和展开,以隐藏或显示特定的代码块。这样可以更好地组织和查看大型的Verilog项目。 4. 代码模板:模板功能使得可以快速插入常用的Verilog代码片段,例如模块定义、寄存器定义等,提高代码的编写速度和一致性。 5. 代码跳转:通过快捷键可以方便地在模块之间进行跳转,快速浏览和编辑代码。 6. 语法检查和自动补全:Emacs Verilog Mode可以检查代码中的语法错误,并提供自动补全功能,减少拼写错误和编程失误。 7. 特定的功能块标记:针对Verilog HDL特有的结构和语法,Emacs Verilog Mode提供了特定的功能块标记,如module、always、if-else语句等,以便更好地识别和编辑这些代码块。 总之,Emacs Verilog Mode是一个强大而实用的工具,它简化了Verilog代码的编辑过程,提高了工作效率和代码质量。无论是进行硬件设计还是进行FPGA编程,使用Emacs Verilog Mode都能够帮助开发人员更好地完成任务。
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