phoenix_1981的专栏

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【Verilog】 同步复位和异步复位比较    同步复位 sync 异步复位 async 特点 复位信号只有在时钟上升沿到来时才能有效。 无论时钟沿是否到来，只要复位信号有效，就进行复位。 Verilog描述 always@(posedge CLK) always@(posedge CLK , negedge Rst_n) 优点 1）&nb...

一直都在讨论应该使用同步复位还是异步复位，以及复位和置位是否同时使用的问题。也基本达成一致，我将简要分析一下这么做的原因，不足之处，还请指教：1.复位和置位不能同时使用，因为很多基本电路单元不同时包含复位和置位端； 2.异步复位同步化。 这里只想讨论一下FPGA内部的情况，官方文档推荐： 1.使用同步复位，因为像block ram、DSP等只包含同步复位或置位； 2.复位和置位不能同...