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arm
文章平均质量分 83
伯春岱
这个作者很懒,什么都没留下…
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【aarch64】bitmask immediate
def highest_set_bit(x): pos=-1 while x!=0: pos+=1 x=x>>1 return pos#imms!=63或imms!=31#imms不为全1 判断:imms&level!=leveldef gen_bitmask(): l=[] for n in range(2): for imms in range(63): for im原创 2021-12-20 14:32:52 · 409 阅读 · 0 评论 -
Detailed analysis for runtime exception vector table and handler in TFA
文章目录1.Entries in TFA2.struct cpu_context3.sync_exception_aarch643.1 apply_at_speculative_wasave_and_update_ptw_el1_sys_regs3.2 check_and_unmask_ea3.3 handle_sync_exception3.3.1 smc_handler64(1) Prototype for runtime service SMC handler function and how to原创 2021-10-12 10:14:45 · 295 阅读 · 0 评论 -
【笔记】makefile学习笔记
参考:https://blog.csdn.net/weixin_38391755/article/details/80380786/0 关于程序的编译和链接编译(compile):把源文件编译成中间代码文件语法正确函数与变量的声明的正确:告诉编译器头文件的所在位置(头文件中应该只是声明,而定义应该放在C/C++文件中)链接(link):把大量的Object File合成执行文件链接函数和全局变量1 Makefile 介绍IEEE 1003.2-1992 标准?1.1 Makefil原创 2021-03-18 15:53:24 · 164 阅读 · 0 评论 -
【笔记】Arm CoreLink Generic Interrupt Controller v3 and v4 Overview
1.概述本文介绍:GICv3中断控制器的相关操作如何在裸机环境下配置GICv3中断控制器本文是_Arm CoreSight Generic Interrupt Controllers_相关指南的三部曲其一:Arm CoreLink Generic Interrupt Controller v3 and v4: Overview (this guide)Arm CoreLink Generic Interrupt Controller v3 and v4: Locality-specific原创 2021-01-08 21:53:36 · 2403 阅读 · 0 评论 -
【笔记】Armv8-A Exception model 异常模型
0.目录文章目录0.目录1.简介2. 特权与异常等级2.1 特权的类型2.2 存储特权2.3 寄存器访问3.执行状态和安全状态3.1 执行状态3.2 安全状态3.3 改变执行状态3.4 改变安全状态3.5 异常等级和执行状态4.异常类型4.1 同步异常4.2 异步异常4.3 IRQ和FIQ4.4 SError5.处理异常5.1 异常术语5.2 处理异常5.3 异步异常路由5.4 确定异常将被带往的执行状态5.5 从异常状态返回5.6 异常栈6.向量表参考1.简介本文介绍:Armv8-A的异常和特权模原创 2021-01-07 19:01:11 · 2043 阅读 · 1 评论 -
【笔记】Armv8-A 内存管理
1. 概述本指南介绍:虚拟地址如何转换为物理地址转换表格式如何管理TLBs对以下可能有所帮助:如boot编程或驱动编程需要设置或管理MMU将能够学会:虚拟地址如何转换为物理地址命名不同的地址空间解释地址空间怎么映射到地址翻译的各个阶段什么时候软件必须维护TLB,以及维护TLB的命令的语法2. 什么是内存管理内存管理描述如何控制系统中对内存的访问。每次操作系统或应用程序访问内存时,硬件都会执行内存管理。内存管理是一种将内存区域动态分配给应用程序的方法。2.1 为什么需原创 2021-01-06 20:44:17 · 1607 阅读 · 0 评论 -
【笔记】Armv8-A virtualization
0.目录文章目录0.目录1.概述1.1 Before you begin2.虚拟化介绍2.1 虚拟化为什么重要2.2 hypervisors的两种类型2.3 全虚拟化和半虚拟化2.4 虚拟机和虚拟CPUs3.AArch64中的虚拟化4.stage 2 转换4.1 什么是stage 2 转换4.2 VMIDs4.3 VMID vs ASID4.4 属性整合和覆盖4.5模拟MMIO(Memory-mapped Input/Output)4.6 系统内存管理单元System Memory Management转载 2021-01-05 20:54:57 · 1011 阅读 · 1 评论 -
【ARM-8】 DCZID_EL0, Data Cache Zero ID register:
作用: 指示DC ZVA(Data Cache Zero by Address)指令写入字节值0的块大小如果实施了FEAT_MTE,那么这个寄存器还指示了DC GVA和DC GZVA的粒度Bits [63:5] :Reserved, RES0.DZP, bit [4] :Data Zero Prohibited.此字段指示是否允许或禁止使用DC ZVA指令0:允许1:禁止BS, bits [3:0] :block size = 2^value * 64 bit,value_max=9,ma翻译 2020-09-14 15:26:50 · 680 阅读 · 1 评论