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基于Hyperlynx VX.2.5 的DDR3仿真之三:Preparing for Simulation
仿真前还需要一些准备工作。比如一些模型的分配等。经过网络模型的添加,发现一个问题,zynq的器件模型中没有具体引脚的相关模型参数。由于在DDR布线时,vivado会生成一个有引脚延迟的.csv文档,截图如下: 而ddr仿真时hyperlynx中的模型分配,以及xilinx官网上下载的ibis模型文件中并不包含这些参数,ddr仿真时存在问题的。所以这里有个迷惑,了解到vivado还可以生成定制的ibis模型文件。参考Vivado Design Suite User GuideViva...原创 2021-03-23 18:39:58 · 703 阅读 · 1 评论 -
基于Hyperlynx VX.2.5 的DDR3仿真之二:Defining Net Classes
Defining Net ClassesContext: BoardSimYou can categorize a group of nets as a net class. This enables you to select a group of nets at once (by net class) or edit settings for a group of nets when the software provides this option.For example, you can cre原创 2021-03-23 18:24:46 · 392 阅读 · 0 评论 -
Zynq-7000 - Which IBIS models should be used for Zynq-7000 devices?
AR# 46871Zynq-7000 - Which IBIS models should be used for Zynq-7000 devices?解决方案 链接问答记录 描述描述Which IBIS model should I use for Zynq-7000 devices?解决方案The Zynq-7000 IBIS models are available on Xilinx.com underDevice Models->IBIS Models...转载 2021-03-23 13:17:25 · 680 阅读 · 0 评论 -
基于Hyperlynx VX.2.5 的DDR3仿真之一:Verifying That the Software Recognizes Your Design Correctly
这是一篇基于Mentor公司 Hyperlynx VX.2.5 仿真软件针对Xilinx ZYNQ 的ZC702 PCB上DDR3内存布局布线的信号完整性仿真分析。层叠结构设置,关键信号的仿真分析,有助于我们了解基于Hyperlynx 对 DDR3 进行信号完整性仿真的整个流程。首先我们从实际出发,我们根据实际板厂的叠层结构阻抗计算,调整了原PCB的叠层结构。首先打开Hyperlynx VX.2.5,导入brd文件。After open a board, Verifying That..原创 2021-03-22 18:02:16 · 1244 阅读 · 0 评论 -
Vivado Design Suite User Guide Design Flows Overview -- Understanding Use Models
一起来充电吧! UG892Chapter 2Understanding Use ModelsVivado Design Suite Use Models 在开始使用Vivado工具进行第一次设计之前,请查看Vivado设计套件用户指南:Vivado Design Suite User Guide: Getting Started (UG910) 正如Vivado设计套件支持许多不同的设计流程,该工具支持几种不同的使用模型,这取决于你想如何...原创 2021-03-21 12:55:29 · 369 阅读 · 0 评论