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原创 FPGA管脚约束-Matlab批量转换Excel文件至ucf约束文件(xls2ucf)

需求在进行FPGA设计时,时常需要编写ucf文件对管脚与信号进行约束,而提供给我们的硬件设计信息经常是excel表格,包括因此需要将excel内的内容转换至ucf中,这是一个巨大的工程,因此编写了一个matlab来批处理这些信息并自动编写ucf管脚约束。Excel内容这里就随便举个例子Matlab转换clear all;close all;clc;%定义各类数值xls_fil...

2019-05-07 20:36:37 904

原创 安装linaro文件系统

参照:https://blog.csdn.net/luotong86/article/details/521707701 下载linaro在尝试了n个版本后发现还是这个版本好使,事实证明最新的不一定能起得来:http://releases.linaro.org/archive/12.07/ubuntu/precise-images/developer/2 u-boot版本修改在尝试2018...

2019-03-04 22:39:28 1912

原创 (zynq)发现一个好网页,哈哈哈真是宝藏

http://www.wiki.xilinx.com/Zynq+Releases

2019-02-27 22:59:09 596

原创 [BD 41-238] Port/Pin property FREQ_HZ does not match

Utility Buffer生成的BUFG端口属性properties不匹配问题参考:https://coldnew.github.io/49454c4d/https://forums.xilinx.com/t5/Synthesis/Vivado-2016-3-Utility-Buffer-issue-Limiting-clock-on-100Mhz/td-p/736176缘由在使用Di...

2019-02-20 21:44:57 9461 3

转载 异步电路处理的三种方法、格雷码与十进制转换verilog

http://dengkanwen.com/238.html

2019-02-15 20:27:21 5586

原创 zynq交叉编译Linux Kernel 全最新环境Vivado2018+Ubuntu2018

开发板:Zybo目标文件:Linux内核文件(UImage和devictree.dtb)编写时间:2019.01PC平台:win10+虚拟机VMware+Ubuntu18.04LTS(64位)开发平台:Xilinx Vivado SDK 2018.3继续上一条博客,继续编译Linux内核文件(UImage和devictree.dtb)记录安装中的问题。1安装支持库执行编译配置命令会出...

2019-02-14 21:51:27 1639

原创 zynq交叉编译Linux u-boot 全最新环境Vivado2018+Ubuntu2018

开发板:Zybo目标文件:u-boot编写时间:2019.01PC平台:win10+虚拟机VMware+Ubuntu18.04LTS(64位)开发平台:Xilinx Vivado SDK 2018.3为了移植Linaro Liunx系统,需要编译u-boot文件,然而在全部使用最新版本的开发环境时,发现网上很多资料已经很陈旧了,走了很多弯路,记录一下。1、安装32位支持库首先需要确认...

2019-01-29 23:12:07 5346

原创 typedef和#ifdef以及流水线的一些理解

关于typedef用法有两个地方讲的挺好的https://www.zhihu.com/question/29798061/answer/144423125https://blog.csdn.net/superhoy/article/details/53504472struct tagPOINT1{ int x; int y;};struct tagPOINT1 p1;...

2018-12-20 21:34:43 987

原创 如何优雅的配置寄存器---ZYNQ Cortex-A9定时器配置函数解析XTmrCtr_SetOptions()

日常废话北京可太冷了,说好要写一段废话,发生了不少事情,好与丧的都有,丧的占大多数。话不能多说,多说就泄露了天机,倒是自己消化了就好。底层寄存器配置与定时器配置函数的引入在使用ARM Cortex-A9的中断系统时,阅读到了一段配置定时器的程序,其中包含的一行程序引起了我的注意。XTmrCtr_SetOptions(&TMRInst, 0, XTC_INT_MODE_OPTION ...

2018-11-04 19:36:26 1807

原创 CARRY4(超前快速进位逻辑结构)和多位比较器/加法器实现

先说一段废话近期萌生了写技术博客的念头,一来是可以记录一些遇到的技术问题,理清思路,也可以记录自己的技术成长;二来是可以将自己的知识分享,以便后人再碰到时能从容不破。希望今后在碰到原创有价值的问题时能坚持这一习惯,也算是督促自己,下面进入正题。问题的引出这里有一个问题,一个32位的比较器需要使用多少个LUT。苦思冥想仍然未能得到答案,写程序后查看RTL网表,得到了答案。但是又看到了一个新的结...

2018-10-01 22:09:43 9567 4

空空如也

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