FPGA
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cugwyman
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使用Verilog实现FPGA偶数/奇数分频电路设计并使用modelsim仿真
一、设计要求编写VerilogHDL程序,实现如下功能:输入时钟信号和复位/信号,实现4分频/5分频,占空比为1:1. 二、设计思路1.偶数分频假设为N分频,计数到N/2-1时,时钟翻转、计数清零,如此循环就可以得到N(偶)分频 2.奇数分频(占空比为50%)(1)假设为N分频,取一个进行上升沿触原创 2017-03-22 23:45:33 · 12255 阅读 · 3 评论 -
使用Verilog实现FPGA计数器功能
本人地大14级师兄,如果有学弟学妹搜到这个评论一个呗!一、设计要求编写VerilogHDL程序,实现如下功能:利用开发板上的数码显示译码器设计一个十进制计数器,要求该计数器具有以下功能:1.计数范围为0-20,计算到20时自动清零,计数间隔时间为1s;2.具有按键异步/同步清零功能; 二、设计思路1. 用一个时钟脉冲,分出两个频率,一个为原创 2017-04-04 19:16:38 · 31195 阅读 · 15 评论 -
使用Verilog实现FPGA双列电梯控制系统
设计目的及要求实现2个8层电梯升降控制设计,该设计模拟完成8层楼的载客服务,同时示电梯运行情况和电梯外请求信息,具体要求如下:1) 每层电梯设有请求开关,电梯可响应按键操作,到达指定楼层;2) 当有请求时,该楼层的指示灯亮;3) 电梯运行时,各楼层有运行模式指示,显示目前电梯是上升或下降。4) 各楼层均有电梯楼层显示,告知等待者电原创 2017-04-15 12:58:48 · 11777 阅读 · 9 评论