2PSK的解调

2PSK只能用相干解调,当已调信号到达接收端后,接收机先用一个带通滤波器滤掉信号带宽以外的那些没用的噪声,然后与本地相干载波相乘,相乘时,正正得正,正负得负,负负得正,因此1对应的载波相乘后全在为正,0对应的载波相乘后全部为负,这就得到了相乘后的信号波形:

接着用一个低通滤波器,将高频的信号变成一个低频的信号,这个低频的信号是一个随时间变化的电压,

但到底哪一段电压代表1,哪一段电压代表0呢?

这需要抽样来判断,怎么样抽样呢?

如下,抽样信号cp(t)的波形图,是一个周期的脉冲串:

每一个数字信号的码元都应该有一个抽样值,因此抽样脉冲与调制信号码元应该是同步的,这个同步也叫位同步

抽样脉冲与低频信号相乘,就等同于抽出在时刻的一个电平值,

然后将这个电平与门限电平作比较:

高于门限,判为1,低于门限,判为0:

整个接收解调的大概原理就是这样的。

是不是解调结构中的低通滤波器可有可无呢?

低通滤波器不可或缺,没有没有了这个低通滤波器,也就没有了那个低频信号,那么抽样脉冲就要在高频信号中直接抽样,

而高频信号在一个码元宽度内,零点很多,保不准就正好抽在这些零点附近,那就很难将抽样值判为1还是0了。

所以不但要用低通滤波器滤掉解调信号中的高频成分,而且最好在抽样时刻,滤波器的输出信号是具有最大信噪比的,这就可以减少误判的可能,达到最佳接收。

用什么来衡量调制的好坏呢?

可靠性和有效性,这是通信系统始终追求的目标。


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作者:李锐博恩(Reborn) 
来源:CSDN 
原文:https://blog.csdn.net/Reborn_Lee/article/details/80791732 
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2PSK(二相移键控)解调是一种常用的数字调制解调技术,用于将传输中的2PSK信号转化为数字数据。Verilog是一种硬件描述语言,用于设计数字集成电路(ASIC)或可编程逻辑器件(FPGA)。 在Verilog中,我们可以使用状态机来实现2PSK解调。首先,我们需要将接收到的2PSK信号与参考信号进行相乘,得到一个实数值。然后,通过判断这个实数值的正负来确定原信号的相位是0度还是180度。最后,将相位信息转化为数字数据输出。 以下是一个简单的Verilog代码示例: ```verilog module PSK2_Demod( input clk, input reset, input signed [N-1:0] in_data, output logic [M-1:0] out_data ); reg [1:0] state; reg signed [M-1:0] accumulator; always @(posedge clk or posedge reset) begin if (reset) begin state <= 2'b00; accumulator <= 0; end else begin case (state) 2'b00: begin accumulator <= 0; if (in_data < 0) state <= 2'b01; end 2'b01: begin accumulator <= accumulator + in_data; if (in_data > 0) state <= 2'b10; end 2'b10: begin accumulator <= accumulator - in_data; if (in_data < 0) state <= 2'b01; end endcase end end always @(posedge clk) begin if (state == 2'b10) out_data <= accumulator; end endmodule ``` 上述代码中,输入信号in_data是一个有符号的N位数据,clk是时钟信号,reset用于复位。输出信号out_data是一个有符号的M位数据,代表解调后的数字数据。 在代码中,我们利用了一个2位的状态机来解调2PSK信号。初始状态为00,表示等待正相位信号。当接收到负相位信号时,状态转变为01,开始累加相位差。当接收到正相位信号时,状态转变为10,继续累加相位差。最后,在状态10时,将累加值输出作为解调后的数字数据。 需要注意的是,上述代码仅作为一个示例,实际实现中可能需要根据具体的设计需求进行修改和调整。
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