Verilog HDL 设计与综合/数字集成电路设计方法概述_part4

最新推荐文章于 2024-03-28 23:15:17 发布
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分类专栏： 数字集成电路设计方法概述 文章标签： verilog 芯片
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21.组合逻辑电路的特点和描述方式
当一个数字电路中的输出信号完全是由输入信号所决定时，这样的电路就称之为组合电路
在这里插入图片描述
案例在这里插入图片描述

最简逻辑表达式是由基本的“与门”或“非门”构成在这里插入图片描述
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可以通过对于硬件描述语言中间的基本门级元器件的调用，来实现结构性描述在这里插入图片描述
硬件描述语言对于组合电路的设计是有多种方式的，应根据电路特点灵活地选择电路描述方式
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22.数字加法器
A和B是加法的加数
CIN是低位向本位的进位在这里插入图片描述
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超前进位加法器可以使得进位标志位能够快速地向高位传输，这样就提高了加法器的运算速度在这里插入图片描述
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硬件描述语言一个很重要的工作就是怎样把我们所需要设计的电路用数学形式先表征出来，然后再写电路时，就会有事半功倍的效果。在这里插入图片描述
23数据比较器和数字校验器在这里插入图片描述
当使用了运算符、可能就会产生电路在这里插入图片描述
数据校验器被广泛应用于数字电路设计中在这里插入图片描述
怎样判断奇数个1？通常采用“异或”操作符
一串：规约运算符在这里插入图片描述
24.数据选择器和数据分配器
条件分支语句是硬件描述语言中一条非常重要的语句，因为在数字电路中，数据选择器本身就作为一个特殊类型电路单独存在，且会被广泛使用在这里插入图片描述
问号操作符作为一种运算符的形式可以被连续赋值语句所直接调用
对于if、else语句来讲，它只能用于过程语句中在这里插入图片描述

凡是在过程语句中左端信号被赋值的这些信号，一定要重新定义成REG类型在这里插入图片描述
和数据选择器相对应的一个电路就是所说数据分配器在这里插入图片描述
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25.数据编码器和数据译码器
BCD编码器就是一个二进制转十进制的编码器
数据编码器是由多线到少线的一个过程
当输入信号比较多时，通常采用case语句加值表的形式进行描述
由于代码中只写了有限的一些状态，捷他状态并未写出，所以在CASE语句最后要加一个 DEFAULT语句在这里插入图片描述

8线-3线编码器通常在控制系统中会使用，依然case语句在这里插入图片描述
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余三编码=8421BCD+3，余3码的特点：当两个十进制数的和是9时，相应的二进制编码正好是15，于是可自动产生进位信号,而不需修正。0和9, 1和8,……5和4的余3码互为反码,这在求对于10的补码很方便。在这里插入图片描述
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