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RSS订阅原创 FPGA时序分析1_FPGA结构
介绍FPGA功能是怎么实现的！！！1.什么是FPGA2.FPGA三要素：逻辑单元（LE）、可编程I/O口、互联线逻辑单元：LUT、DFF、进位链可编程I/O口：I口，O口；输入延时链，输出延时链、进位链：好像是输入的后面的信号【但这个不应该算是后面的信号吗】1.FPGA介绍FPGA：field programmable gate array 【现场可编程门阵列】现场可编程：指的是编程可直接在现场进行，意味着FPGA的即时可得性。门阵列：FPGA可编程功能主要是..
2021-02-01 19:50:30
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原创 linux学习：添加新硬盘
2020.3.20存储空间不够，添加新硬盘1.先关机，编辑设置，添加，添加硬盘，确定2.fdisk -l 查询系统中硬盘是否可被检测3.使用fdisk命令分区#fdisk /dev/sdb4.按 m 按照帮助，辅助下一步工作5.n 选择主分区，扩展分区6.p 选择分区号 1 【一般不要跳开，接着按顺序分】7.开始分区 多少个分区【+ 号可以按G M大小来分】8.p一下，展...
2020-03-24 20:20:34
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原创 linux学习：网络基础
------未整理---------------linux的网络基础1.网络相关概述1.网络发展：信息传递，电的产生，网络的诞生（1969年诞生internet元年） 1970.unix元年。网络的分类：局域网 ：localarea network LAN 指范围或十几公里内办公楼群或校园内的计算相互连接说构成的计算的网络城域网：（metropolitan area netwo...
2020-03-23 10:33:49
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原创 linux学习：sudo操作
sudo操作问题：reboot shutdown init 0 halt在普通用户身份都是操作不了，但是有些特殊的情况又需要有执行权限，又不可能让root把自己的密码告诉普通用户，这个问题该如何解决。该问题是可被解决得，可以使用sudo（su do）命令来进行权限设置，sudo可以让管理员（root）事先定义某些特殊命令谁可以执行。默认sudo中除了root之外用户的...
2020-03-21 14:22:16
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原创 linux学习：修改用户名和主机名
2020.3.171.用户管理多用户多任务的操作系统，任何一个要使用系统资源的用户都必须首先向系统申请一个账号，然后以账号登录系统。用户的账号一方面可以帮助系统管理员对使用系统的用户进行跟踪，并控制他们对系统资源的访问，另一个方面也可以帮助用户组织文件，并未用户提供安全性保护。每个用户在登录时键入正确的用户和密码后，就能进入系统和自己的工作目录想实现用户账号的管理，要完成的工作主要...
2020-03-19 12:18:52
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原创 linux学习3
2.4 高级指令1.hostname 指令作用：操作服务器的主机名 【读取，设置】语法1：#hostname 【输出完整的主机名】语法2：#hostname -f 【输出当前主机名的FQDN，全限定域名】语法3：#hostname newname 【将主机名临时重命名为newname，重启后会复原】2.id 指令作用：用于查看用户的基本信息 【包含了用...
2020-03-19 09:27:43
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原创 linux学习2
**记录学习，记录成长2.3 进阶指令1.df 指令 作用：查看磁盘空间语法格式：#df -h 【-h表示以可读性较高的形式表示，意思就是让你更容易看懂】[user@user Desktop]$ df -hFilesystem Size Used Avail Use% Mounted ontmpfs 49...
2020-03-18 17:44:24
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原创 linux学习1
**记录学习，记录成长1.基础的终端操作：1.1终端显示当前终端登录的用户名 @ 当前登录的主机 当前工作目录 身份识别符（# / $） 命令输入区其中“#”代表超级管理员 “$”代表普通用户。1.2.关机命令：shutdown -h now（正常关机，支持定时关机）、halt（关闭内存）1.3.备份方式：快照，克隆快照：又称还原点，保存在拍快照时的系...
2020-03-18 15:47:52
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原创 VHDL自定义库 （程序包的使用）
**记录学习，记录成长VHDL自定义库（程序包的使用）VHDL中默认一个work库作为用户的project的设计库，用户可以通过定义PACKAGE（程序包）来定义work库中的内容。程序号（PACKAGE）的定义分为两部分内容：包首部分和包体部分在多个元件例化时，可将元件声明部分放在定义程序包中。通过使用该库，在调用元件时，不用再次声明元件，可直接使用库中元件。package tes...
2020-03-07 21:00:13
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原创 VHDL中元件（模块）的例化
**记录学习，记录成长1.VHDL中元件的例化可分为两部分第一部分：元件声明，声明要例化的元件。第二部分：元件例化，声明结束之后就可以对元件进行例化或者说是调用了。其中声明部分在结构体的说明语句部分（即architecture和begin之间）。而调用部分同一个结构体的电路描述部分（即begin之后）。2.元件声明格式：Component 元件名称 isPort（元件端口信息）；E...
2020-03-06 14:39:04
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原创 VHDL中的signal（信号）variable（变量）的定义与赋值
VHDL中的signal（信号）variable（变量）的定义与赋值variable（变量）1.变量只能在process（进程）和子程序中定义和使用 process (clk) variable v1 : integer := 0; --在说明语句部分定义变量 begin --在begin之后被赋值 v1 := 2; ...
2020-03-04 12:51:17
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crc并行计算_64位并行_matlab文件
2020-04-23
VHDL官方参考手册（1076-2008）.pdf
2020-02-29
CAN_FD_Specifiaction.pdf
2020-02-18
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