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原创 芯片设计的隐形瓶颈:STA 中的延迟到底怎么算?

在数字芯片设计中,“是否按时完成计算”是时序分析的核心问题。静态时序分析(STA)通过扫描整个电路的路径拓扑,验证所有可能的数据传播路径是否在时钟周期限制内完成。而延迟,是衡量这条路径能否“及时抵达”的时间成本。

2025-05-09 16:40:34 274

原创 快速构建OpenROAD开发环境:配置、编译与运行

OpenROAD(Open Rapid Object-Oriented Design)项目旨在构建一个完整的、可重复的、开源的数字芯片后端设计流程(RTL-to-GDS)。它对教育、研究和初创芯片公司都极具吸引力,为数字芯片设计提供了强大的工具链,而无需昂贵的商业 EDA 工具。本文将带你快速完成 OpenROAD 环境的配置、源码编译、并运行一个简单设计,从零开始掌握 OpenROAD 的基本使用方法。

2025-05-08 16:53:48 1674

原创 如何用 Docker 和 VSCode 高效开发 OpenROAD 项目

OpenROAD(Open Routing and Optimizing and Assembly of Designs)是一个开源的数字芯片后端设计工具,致力于实现数字 IC 设计的自动化流程。项目由多个子模块组成,支持完整的 RTL-to-GDSII 流程,广泛用于学术研究和开源芯片开发中。我们首先需要从 GitHub 上克隆 OpenROAD 项目。克隆完成后,你就得到了完整的 OpenROAD 源码及其依赖,为后续基于 Docker 的构建和远程开发做好准备。

2025-05-07 16:32:54 315

原创 复合电流源 (Composite Current Source)

NLDM(Nonlinear Delay Model)使用 LUT(查找表)建模延迟和转换时间,它的延迟计算方式很简单:输入条件:输入的 slew(转换时间)+ 输出的负载电容输出结果:对应的 delay 和 output transition(输出边沿rf)假设波形是理想的(近似线性)实际波形可能是非线性或受干扰的(串扰/噪声),但 NLDM 无法表达这些波形细节。只考虑 0.5VDD 点只关心输入输出达到 0.5VDD 的时间,却忽略了整条波形路径,容易低估/高估 delay。

2025-05-07 15:51:54 1373

VLSI设计中的高级模型降阶技术:线性动态电路终端缩减与紧凑建模

VLSI设计中的高级模型降阶技术:线性动态电路终端缩减与紧凑建模

2025-05-13

CCS Timing Library Characterization Guidelines

内容概要:本文档由Synopsys发布,旨在为库开发者提供CCS(复合电流源)计时库特征化指南。CCS技术是电子设计自动化行业中首个基于电流建模的解决方案,涵盖时序、噪声和功耗。文档详细描述了CCS计时模型的要求,包括驱动器模型和接收器模型的具体要求。它还介绍了如何进行CCS计时特征化,确保符合Synopsys Galaxy签核平台的后布局RC延迟计算需求。此外,文档讨论了库特征化的关键考虑因素,如电路仿真设置、输入特征化波形、延迟和转换时间阈值点的选择等。最后,文档总结了Library Compiler对CCS计时库的检查要求。 适合人群:具备一定IC设计和库特征化经验的工程师和技术人员,特别是那些需要使用或开发CCS计时库的人。 使用场景及目标:①帮助库开发者创建准确的CCS计时库,用于后布局RC延迟计算;②指导如何选择合适的特征化参数,确保库的精度和可靠性;③解释CCS计时库在PrimeTime中的应用,确保时序分析的准确性。 其他说明:本文档适用于Library Compiler版本X-2005.09-SP3及之后的版本。文档还包括对CCS计时Liberty扩展(2016年6月)的介绍,支持多段接收电容建模,以提高时序分析的准确性。同时,文档提供了详细的错误和警告消息示例,帮助开发者识别和解决问题。

2025-05-07

CCS Technology

内容概要:本文介绍了Synopsys公司提出的复合电流源(CCS)技术,涵盖其在时序、噪声和功耗分析中的应用。CCS技术提供了高精度的延迟和斜率计算,支持多电压设计,包括动态电压频率调节(DVFS),并能高效地进行特征化。CCS噪声模型比传统的非线性延迟模型(NLDM)快100倍,同时保持高精度,能准确模拟噪声传播和驱动器减弱。CCS功耗模型支持多电压设计、静态和动态电源轨分析,并为所有与功耗相关的应用提供统一的库模型,包括电源优化、动态电源轨分析和功耗分析。 适合人群:具有电子工程或相关领域背景的专业人士,尤其是从事集成电路设计和验证的工程师。 使用场景及目标:①用于90纳米及以下工艺节点的设计,提高时序、噪声和功耗分析的准确性;②支持多电压设计和动态电压频率调节;③加速库特征化,减少电路仿真时间;④确保电源轨分析的准确性,支持细粒度和粗粒度的电源门控设计。 其他说明:本文还提供了CCS技术的背景资料和技术文档链接,帮助用户深入了解和应用CCS技术。具体的技术文档和更多资源可以在Synopsys官方网站上获取。

2025-05-07

Synopsys CCS Timing Technical White Paper

内容概要:本文档由Synopsys发布,主要介绍了用于精确高效单元级延迟计算的CCS(Composite Current Source)Timing模型。随着集成电路设计进入90nm及以下工艺节点,物理效应和设计风格的变化给延迟计算带来了新的挑战。CCS Timing模型通过创建驱动器模型、降阶模型(如Block Arnoldi)和接收器模型来替代实际电路组件,从而实现高精度和快速计算。该模型解决了传统Thevenin和Norton模型在处理高阻抗网络时的局限性,提供了对输入边沿、输出负载、切换方向和单元状态的依赖性的强大捕捉能力。此外,CCS Timing支持多电压域(multi-Vdd)和动态电压频率调节(DVFS)设计,并能进行非线性Vdd缩放。; 适合人群:从事数字集成电路设计和验证的工程师,特别是那些需要进行精确延迟计算和时序收敛的专业人士。; 使用场景及目标:①适用于90nm及以下工艺节点的设计,确保在高阻抗网络下的高精度延迟计算;②支持多电压域和动态电压频率调节设计;③提高时序分析的准确性,减少与电路仿真之间的误差;④优化延迟计算以应对复杂的物理效应和设计风格变化。; 其他说明:文档详细描述了CCS Timing的建模方法、表征过程及其相对于传统模型的优势。同时,还介绍了紧凑型CCS格式和变异感知扩展,以减少数据量并适应工艺变化。读者可参考相关文档获取更多信息。

2025-05-07

空空如也

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