INCASEFORMAT 病毒来袭， 猎鹰安全解决方案

于 2021-01-14 16:22:19 发布
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INCASEFORMAT 病毒来袭， 今天给大侠带来猎鹰安全解决方案，话不多说，上货。

 

 

一、事件简介

 

昨天开始INCASEFORMAT 病毒大面积爆发。今日猎鹰安全收到用户上报的相关问题，反应很多电脑开机就出现除C盘外数据丢失或直接被格式化，猎鹰安全提醒用户，如有重要数据不要向数据盘里再存入数据！固态硬盘可能存在数据丢失。如没有发生此状况的，注意不要点不明链接，不要更新漏洞补丁！

 

 

二、病毒分析

 

电脑中除C盘之外的其他磁盘文件都被删除，且磁盘中可能被创建“incaseformat”文本文档。

 

经过查看故障环境，确认问题原因是电脑中病毒后，病毒文件通过DeleteFileA和RemoveDirectory代码实现了删除文件和目录的行为。

 

病毒类型：蠕虫病毒

 

传播方式：U盘隐藏正常文件夹，并替换为同名样本母体

 

行为特征：

 

1. 删除C盘以外的盘符数据，释放文件incaseformat.txt

 

2. 拷贝副本至C:\windows\ttry.exe、C:\windows\tsay.exe

 

3. 已知md5:1071d6d497a10cef44db396c07ccde65

 

 

 

4. 注册表创建启动项HKEY_LOCAL_MACHINE\SOFTWARE\Microsoft\Windows\CurrentVersion\RunOnce\msfsa

 

 

三、预防方式

 

1.确保近期内做一次云转查，使本地新型样本更新到最新。

 

2.确保终端开启监控模式。

 

 

3. 确保开启边界防御，当U盘接入电脑会进行报毒拦截，提高防杀毒意识，对重要文件数据做好备份，使用U盘前进行安全检测，不要直接运行文件。

 

 

4. VGM防毒墙可利用威胁情报追溯威胁行为轨迹，帮助用户进行威胁行为分析、定位威胁源和目的，追溯攻击的手段和路径，从源头解决网络威胁，最大范围内发现被攻击的节点，帮助企业更快响应和处理。

 

 

 

四、病毒处理方式

 

1.针对此问题只需进行全盘扫描对该病毒查杀。

 

 

2.为避免此类病毒大规模爆发，猎鹰安全建议用户制定每周定时全盘查杀策略，做到每周至少一次全网全盘扫描。

 

 

 

 

END

 

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01-05 6308
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Verilog和system Verilog应该怎么自学?
09-24 63
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为什么FPGA属于硬件，还需要搞算法？
09-24 134
至于 PCB设计，对于单纯的 FPGA 开发，通常不是必需的。FPGA 虽然是硬件，但它具有可编程性，要实现特定的功能，如数字信号处理、图像处理、加密解密等，就需要设计相应的算法来指导硬件资源的配置和利用，以达到期望的性能和功能。总的来说，学习 FPGA 需要综合掌握语法、硬件架构、算法设计等多方面的知识，随着学习的深入，你会逐渐理解它们之间的关系和相互作用。单纯搞算法就行了吗？单纯搞算法是不够的，还需要理解硬件的架构和资源，以便更有效地将算法映射到 FPGA 上，实现最优的性能和资源利用。
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异步FIFO地址从快时钟域同步到慢时钟域的问题
09-24 36
2. 从快时钟域到慢时钟域，存在漏采样的可能性。在快时钟域中地址变化较快，如果慢时钟的采样频率跟不上快时钟域地址的变化频率，就可能出现漏采样的情况。为了减少漏采样的风险，通常会采用一些特殊的设计技巧，比如使用格雷码来表示地址，或者增加一些握手信号来确保数据的准确传输。：异步FIFO地址从快时钟域同步到慢时钟域的问题，谁能解答一下啊？2. 从快时钟到慢时钟，会不会漏采样，就是快时钟域的地址会被扣掉?我想问一下异步FIFO地址从快时钟域同步到慢时钟域，两个问题。1. 是多bit打拍，这样会不会有时延?
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09-24 138
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SDRAM掉电能保持多长时间？
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需要注意的是，SDRAM 通常用于需要快速读写数据的场合，例如计算机的内存。在实际应用中，为了避免数据丢失，系统通常会在掉电前采取措施将重要数据保存到非易失性存储器（如硬盘、闪存等）中，或者使用不间断电源（UPS）来维持系统的供电，以确保数据的安全性和完整性。在低温环境下，数据可能可以保存相对较长的时间，比如 1 个小时左右，但这也不是绝对的，而且长时间的低温保存并不常见。如果对数据的保存有较高要求，建议使用具有非易失性的存储介质来长期存储重要数据，而不仅仅依赖 SDRAM 的短暂数据保持能力。
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答疑系列：深入应用FPGA技术，对于人形机器人的实用化可能产生哪些影响？
09-24 144
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1. 组成结构：有源晶振内部包含晶体和外围电路，一般有四个引脚，分别为电源、接地、信号输出端和空脚（NC）；3. 性能精度：有源晶振的精度可达0.1ppm，无源晶振的精度为5ppm。有源晶振在稳定性方面优于无源晶振，但信号电平固定，灵活性较差。7. 体积大小：有源晶振由于自身增加了振荡电路，体积一般较大，但现在很多有源晶振采用表贴形式，体积得以缩小，与无源晶振差不多甚至更小。6. 成本方面：无源晶振电路的成本相对较低，而有源晶振电路在产品性能上有优势，但价格较高。：有源晶振和无源晶振有哪些区别？
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OFDM里面如何将发射数据添加到载波上面？
09-23 120
IFFT 将数据从频域转换到时域，从而将数据分配到各个子载波上。每个子载波都有特定的频率，经过 IFFT 后，数据就被添加到了不同频率的载波上。首先，将待发射的数据进行调制。常见的调制方式有 QPSK、16QAM等。调制的目的是将数字信号转换为适合在信道上传输的模拟信号形式。将调制后的串行数据转换为并行数据。这是因为 OFDM 是一种多载波技术，需要将数据分配到多个子载波上。：咨询各位大佬个问题，OFDM里面如何将发射数据添加到载波上面？通过以上步骤，就可以将发射数据添加到 OFDM 的载波上。
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自定义IP核给他人使用，不想显示源码，有什么办法？
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除了生成.dcp 文件，还可以将 IP 核封装为网表（Netlist）形式提供给他人使用。不过生成.dcp 是一种较为常见和有效的方式，能够在一定程度上保护源码的隐私性。：自定义的IP核给他人使用，不想显示源码。是不是只有生成.dcp这一种办法？
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为什么电路要设计得这么复杂？
09-23 79
1. 功能需求多样化 ：现代电子设备需要实现众多复杂的功能，如高速数据处理、精确的信号传输、强大的计算能力等。2. 性能优化 ：要实现高效的能量利用、低噪声、高速度、高精度等性能指标，电路的设计就需要考虑各种因素，如元件的选择、布线的优化、信号的完整性等，这必然导致设计的复杂性增加。在有限的空间内集成大量的元件和功能，需要精心设计电路的布局和连接，以避免干扰和冲突。5. 兼容性和标准化 ：电路需要与其他设备和系统兼容，遵循各种行业标准和规范，这要求在设计中考虑众多的接口和协议，使得电路设计更加复杂。
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ADC中全差分开关工作原理
09-23 60
例如，如果VIP大于VIN，那么输出数字码的最高位为1，同时通过切换电容阵列上的开关使VIP减小VREF/4，VIN增大VREF/4（这里的VREF/4是根据逐次逼近的算法确定的第一步调整量）。然后进行第二次比较，此时是基于第一次比较后调整的VIP和VIN的值继续比较，确定次高位，依此类推，逐步确定各个位的值，直到完成整个转换过程。在全差分ADC的工作过程中，第一次比较是VIP和VIN的比较，而不是与参考电压Vref比较，这是由其工作原理和逐次逼近的算法决定的。：请教一下ADC中全差分开关工作原理？
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FPGA芯片内有哪两种存储器资源？
09-23 179
2. 分布式存储器（Distributed RAM）：由 FPGA 中的查找表（LUT）等逻辑资源构建而成。适用于小规模的存储需求，具有灵活的地址线和数据线配置。1. 块存储器（Block RAM）：可以实现较大容量的数据存储，常用于存储大量的数据表格、图像数据等。具有较高的存储密度和可配置性。：FPGA芯片内有哪两种存储器资源？
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Xilinx ddr3 仿真时，有什么办法能快速初始化完成？
09-23 302
要快速完成 Xilinx DDR3 Modelsim 仿真的初始化，可以从优化测试平台、调整模型参数和利用脚本及自动化工具等方面入手。在进行任何调整时，都要确保仿真结果的正确性，并进行充分的测试和验证。• 仔细阅读 Xilinx DDR3 模型的文档，了解是否有特定的参数可以调整以加速初始化。• 尝试调整 DDR3 初始化序列中的参数，如延迟时间、等待周期等。• 减少不必要的逻辑和模块，只保留与 DDR3 初始化相关的关键部分，以降低仿真的复杂性，从而加快初始化过程。2. 调整初始化序列参数。
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slicem中lut是6输入的，但实现移位寄存器深度是32，不是64，原因是什么呢？
09-23 20
3. 性能和功耗平衡：较深的移位寄存器可能会增加功耗和延迟，为了在性能和功耗之间达到平衡，选择了 32 的深度。1. 资源限制：芯片的物理资源有限，设计上可能对移位寄存器的深度进行了权衡和优化，以适应整体的资源分配。：请问slicem中lut是6输入的，但实现移位寄存器深度是32，不是64，原因是什么呢？2. 功能需求：在特定的应用场景中，32 的深度已经能够满足功能要求，无需扩展到 64。
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直接调用一个双端口192KB的SRAM，和调用12个大小为16KB的SRAM，占用资源是一样的吗？
09-23 27
但是，调用一个大的双端口 SRAM 可能在控制逻辑上相对简单，占用的控制逻辑资源可能会少一些。另一方面，使用 12 个小的 SRAM 需要更多的地址译码逻辑来分别选中不同的小 SRAM，并且可能在布局布线时需要更多的空间，占用更多的芯片面积资源。：直接调用一个双端口 192KB 的 SRAM 和调用 12 个大小为 16KB 的 SRAM 占用的资源不完全一样。：请教一个问题，直接调用一个双端口192KB的SRAM，和调用12个大小为16KB的SRAM，占用资源是一样的吗？
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