奋斗的小孩系列 FPGA学习altera系列: 第二十六篇 奇分频设计

本文是奋斗的小孩系列FPGA学习altera的第二十六篇,主要介绍奇分频设计,要求实现占空比为50%。通过分析设计,使用两个计数器分别在时钟上升沿和下降沿计数,最终通过逻辑组合得到所需占空比的信号。文章提供设计代码及仿真波形,并邀请读者加入FPGA技术交流群进行讨论。
摘要由CSDN通过智能技术生成

奋斗的小孩系列 FPGA学习altera系列: 第二十六篇 奇分频设计

作者:奋斗的小孩 郝旭帅(转载请注明出处)

大侠好,欢迎来到FPGA技术江湖,江湖偌大,相见即是缘分。大侠可以关注FPGA技术江湖,在“闯荡江湖”、"行侠仗义"栏里获取其他感兴趣的资源,或者一起煮酒言欢。

今天给大侠带来“FPGA学习系列altera"系列,持续更新。

此学习心得是本人之前所写,所用设计软件为Quartus II 13.1,现Quartus 新版本已更新到20+,以下仅供初学者学习参考。后续会更新其他系列,敬请关注。话不多说,上货。

 

奇分频设计

对于每一个的小实验,我们都可以把它看作是一个小项目,逐步的去分析,设计,调试,最后完成功能。下面我们就开始我们的“小项目”。

项目名称:奇分频;

具体要求:奇分频且占空比为50%;

项目分析:将外部的时钟进行奇数分频,且要求占空比为50%。

构图如下:

06-10 243
02-09 489
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