FPGA系统性学习笔记连载_Day18【线性系列机】之【110110 二进制包头检测实验】篇

于 2021-04-07 19:07:00 发布
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分类专栏： FPGA零基础学习系列，初学者必备 文章标签： fpga零基础学习 线性序列机 verilog
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本篇博客是关于FPGA系统性学习的Day18内容，主要介绍如何使用线性系列机进行110110二进制包头检测实验。通过状态转移图分析和Verilog代码实现，成功设计了一个能检测特定包头并输出脉冲信号的状态机。同时提供了仿真文件和效果展示，并推荐了FPGA学习交流群。
摘要由CSDN通过智能技术生成

FPGA系统性学习笔记连载_Day18【线性系列机】之【110110 二进制包头检测实验】篇

本系列为FPGA系统性学习学员学习笔记整理分享，如有学习或者购买开发板意向，可加交流群联系群主。

连载《叁芯智能fpga设计与研发-第18天》【线性系列机】之【110110 二进制包头检测实验】篇

原创作者：紫枫术河 转载请联系群主授权，否则追究责任

本实验利用状态机知识，做一个线性系列机包头检测。

实验要求：检测特定的包头 110110，当检测到输出一个clk的脉冲信号出来。

一、分析110110的状态转移图

1.1、状态转移图如下表

1.2、状态转移表

二、verilog代码实现

module FSM_bin_seqence_check(
    input      
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