片上网络NOC（Network on Chip）相关总结转载~

最新推荐文章于 2024-04-11 23:14:47 发布

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NOC相关知识如下，以备常常回顾温习，直接转载，原文为：

片上网络（network-on-chip，NoC)基础知识之NoC发展背景_sourceCoder-hulz的博客-CSDN博客_noc片上网络

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NoC是相对于SoC的新一代片上互连技术，要深入了解NoC必须深刻认识SoC，故本文组织结构为：
1、SoC产生背景
2、SoC的局限性
3、NoC架构简单介绍
摩尔定律指出：产品的价格保持不变的情况下，IC中集成的元器件数量每两年能够翻一番，与此同时其性能也会提高一倍。在过去的几十年发展中，摩尔定律不断的得到充分的验证，而且根据预测，IC的这种发展趋势将会持续下去。这就为SoC发展奠定了硬件基础。
而商业应用对产品功能的需求不断提高，对处理器运行速度、服务质量要求越来越高，芯片的集成度越来越高，因而单个芯片上集成的元器件数目不时提升，能够实现的功能也不断完善。然而，随着芯片集成的部件越来越多，部件之间的通信效率逐渐成为制约芯片性能的重要因素。由此，研究学者们提出了片上系统通讯架构（System on chip, SoC）
SoC整体架构图如下：

目前，SoC通讯架构的设计相对比较成熟。大部分芯片公司芯片制造都采用SoC架构。然而，随着商业应用开始不断追求指令运行并存性和预测性，芯片中集成的核数目将不断增多，基于总线架构的SoC将逐渐难以不断增长的计算需求。其主要表现为：
1、可扩展性差。SoC系统设计是从系统需求分析开始，确定硬件系统中的模块。为了使系统能够正确工作，SoC中各物理模块在芯片上的位置是相对固定的。一旦在物理设计完毕后，要进行修改，实际上就有可能是一次重新设计的过程。另一方面，基于总线架构的SoC，由于总线架构固有的仲裁通信机制，即同一时刻只能有一对处理器核心进行通信，限制了可以在其上扩展的处理器核心的数量。
2、平均通信效率低。SoC中采用基于独占机制的总线架构，其各个功能模块只有在获得总线控制权后才能和系统中其他模块进行通信。从整体来看，一个模块取得总线仲裁权进行通信时，系统中的其他模块必须等待，直到总线空闲。
3、单一时钟同步问题。总线结构要求全局同步，然而随着工艺特征尺寸越来越小，工作频率迅速上升，达到10GHz以后，连线延时造成的影响将严重到无法设计全局时钟树的成都，而且由于时钟网络庞大，其功耗将占据芯片总功耗的大部分。
NoC的主题思想是将宏观网络的通讯措施应用于芯片上，每个核当做一个独立的单元，IP核经过网络接口与特定的路由器相连。由此，将IP核之间的通信转换为路由器与路由器的通信。通常情况下的NoC架构如下图所示：

R为路由节点，IP为计算节点。
传统的NoC架构主要由路由器节点、IP核、资源网络接口、通道组成。
**1、资源节点：**主要包含计算节点和存储节点。计算节点包含处理器即IP核（CPU、DSP等），存储节点包含ROM、RAM、DRAM、SDRAM等
2、通信节点：即路由节点或路由器，主要负责完成IP核之间的数据通信任务。NoC中资源节点产生一个数据包后，会通过特定的接口发送到源路由器中，源路由器会读取数据包的头微片中的地址信息，通过特定的路由算法计算出最佳路由路径，从而树立可靠的传输到目的节点，最终由目的IP核接收此信息。
3、资源网络接口：其功能就是作为通信节点与功能节点之间的接口。主要功能有完成数据包的封装与解封装，在源节点的资源网络接口中将原地址信息以及目的地址信息等封装到数据包的头微片中；在目的节点的资源网络接口中将原地址信息以及目的地址信息等删除。
**4、通道：**实质为双向金属链路，用以保证节点间的数据传输。分为内部通道和外部通道，内部通道为资源节点和通信节点之间的金属链路，外部通道指通信节点之间的金属链路。
NOC架构优势：
**1、良好的可扩展能力。**一方面，相比于SoC架构，不在受限于总线架构，可以扩展任意数量的计算节点。另一方面，需要对系统功能进行扩展时，只需要将设计好的功能模块通过资源网络接口植入网络，无需重新设计网络整体架构。
**2、较高的通信效率。**一方面NoC将IP核之间的数据传输演变成为路由器之间的数据转发，IP核节约了一部分的计算资源。另一方面避免了总线架构同一时刻只能有一对通信节点进行通信的问题，可以实现同一时刻多对节点通信。
3、功耗。NoC中采用全局异步局部同步的时钟机制，其功耗开销远低于SoC。NoC中局部模块运用同步时钟域，而全局上采用异步时钟，降低了由于全局时钟同步所带来的动态开销，同时，NoC中的时钟树设计复杂度也低于SoC。
4、数据传输可靠性。随着集成电路特征尺寸的不断减小，电路规模的不断增大，互连线的宽度和间距也在不断地减小，线间耦合电容相应增大，长的全局并行总线会引起较大的串扰噪声，从而影响信号的完整性以及信号传输的正确性。同时，互连线上的延迟将成为影响信号延迟的主要因素，总线结构全局互连线上的延迟将大于一个时钟周期，从而使得时钟的偏移很难管理。
本文参考了https://www.eefocus.com/srnoc/blog/15-09/319333_0b2d8.html
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另外总结的较好的如下：

NoC（Network on Chip）学习笔记（1）_Tommyll的博客-CSDN博客_noc模块

NoC（Network on Chip）学习笔记（2）_Tommyll的博客-CSDN博客