2440裸机-11-1UART硬件介绍

转载:https://www.cnblogs.com/fuzidage/p/12003751.html

1.uart硬件介绍

UART的全称是Universal Asynchronous Receiver and Transmitter(异步收发器)。 uart主要用于:

1.打印调试
2.数据传输

串口通过三根线即可,发送、接收、地线。
在这里插入图片描述

2.uart的参数和格式

波特率:表示每秒传输多少bit,bits per second(bps).一般波特率都会有9600,19200,115200等选项。
格式:
注意:起始位前一直保持高电平

起始位: 先发出一个逻辑”0”的信号,表示传输数据的开始。
数据位:可以是5~8位逻辑”0”或”1”。一般7位,刚好可以传输所有ASCII码。
校验位:
奇校验:(校验位+数据位)使得“1”的位数为奇数
偶校验:(校验位+数据位)使得“1”的位数为偶数
举个栗子:
‘A’的ASCII值是0x41,二进制就是01000001,那么奇校验就在校验位写‘1’,偶校验就在校验位写‘0’
停止位:它是一个字符数据的结束标志。

3.uart是如何输出字符‘A’的

‘A’的ASCII值是0x41,二进制就是01000001,怎样把这8位数据发送给PC机呢?

1.双方约定好波特率(每一位占据的时间)
2.规定传输协议

现在处于这种模式:arm的TxD -> pc的RxD (UART read)

1.arm拉低uart总线1bit的时间(起始位)
2.arm根据数据位依次驱动TxD的电平,同时PC依次读取uart总线,数据到达PC的RxD引脚,pc依次获得数据位

为了能够进行远距离的传输数据,我们的PC是使用的RS-232逻辑电平,而arm开发板使用的TTL/CMOS逻辑电平。这里先讲解下什么是TTL逻辑电平,什么是RS-232逻辑电平。

TTL/CMOS逻辑电平:

0(低电平0-0.7v)表示逻辑’0’
1(高电平2-5v) 表示逻辑’1’

在这里插入图片描述
RS-232逻辑电平:

(+3V ~ +12V) 表示逻辑’0’
(-12V ~ -3V) 表示逻辑’1’

在这里插入图片描述
那么在起始信号开始后开始计时,arm每隔一个发送位的时间往TxD放1bit数据,同时pc也从RxD get 1bit数据.

假设波特率为115200,发送位时间为1/115200;

arm pc
TxD=data[0:], data[0:]=RxD
TxD=data[1:], data[1:]=RxD

TxD=data[7:], data[7:]=RxD

为什么用RS232?

我们知道RS232的逻辑’0’和逻辑’1’相差较大,比TTL/CMOS差距大,那么逻辑电平不容易出现反转,能传输更远的距离,在工业上用得比较多。

所以我们上面PC拿到的数据是不对的,那么需要一个TTL转RS232的电平转换芯片。

在这里插入图片描述

4.ARM芯片是如何收发数据

在这里插入图片描述
发送数据:

内存将数据放入发送FIFO(64byte),通过发送移位器将数据一位一位的依次发送到TXDn,这样PC就可以从总线上依次get到数据。

接收数据:

当pc的TXDn端将数据发送到总线后,arm获取RXDn的引脚电平依次get到数据,逐位放进接收移位器,再放入FIFO,写入内存。

当然,也可不使用fifo,直接让内存与移位器交互,不过这样会造成浪费内存资源,内存的频率是很高滴,降低了内存的吞吐量。

5.FIFO

FIFO是先进先出缓冲区的意思,即串口接收到的数据可以先进入FIFO,不必马上进入中断服务程序接收,这样可节省CPU时间。对于发送数据也一样,可以把要发送的数据一起写入FIFO,串口控制器可按写入顺序依次发送出去。

以下内容为转载转载

看来许多人还没有真正理解FIFO的作用和优点,仍然停留在每收发一个字符就要中断处理一次的老思路上。UART收发FIFO主要是为了解决收发中断过于频繁而导致的CPU效率不高的问题。 
 
FIFO的必要性。在进行UART通信时,中断方式比轮询方式要简便且效率高。但是,如果没有收发FIFO,则每传输一个数据(5~8位)都要中断处理一次,效率仍然不高。如果有了收发FIFO,则可以在连续收发若干个数据(可多至14个)后才产生一次中断,然后一起处理。这就大大提高了收发效率。

接收超时问题。如果没有接收超时功能,则在对方已经发送完毕而接收FIFO未填满时并不会触发中断(FIFO满才会触发中断),结果造成最后接收的有效数据得不到处理的问题。有了接收超时功能后,如果接收FIFO未填满而对方发送已经停,则在不超过3个数据的接收时间内就会触发超时中断,因此数据会照常得到理。

总之,FIFO的设计是优秀而合理的,它已经帮你想到了收发过程中存在的任何问题,只要初始化配置UART后,就可以放心收发了,FIFO和中断例程会自动搞定一切!  完全不必要担心FIFO大大减少了中断产生的次数而“可能”造成数据丢失的问题!  发送时,只要发送FIFO不满,数据只管往里连续放,放完后就直接退出发送子程序。随后,FIFO真正发送完成后会自动产生中断,通知主程序说:我已经完成真正的发送。  接收时,如果对方是连续不间断发送,则填满FIFO后会以中断的方式通知主程序说:现在有一批数据来了,请处理。  如果对方是间断性发送,也不要紧,当间隔时间过长时(2~3个字符传输时间),也会产生中断,这次是超时中断,通知主程序说:对方可能已经发送完毕,但FIFO未满,也请处理。

  • 0
    点赞
  • 0
    收藏
    觉得还不错? 一键收藏
  • 0
    评论
评论
添加红包

请填写红包祝福语或标题

红包个数最小为10个

红包金额最低5元

当前余额3.43前往充值 >
需支付:10.00
成就一亿技术人!
领取后你会自动成为博主和红包主的粉丝 规则
hope_wisdom
发出的红包
实付
使用余额支付
点击重新获取
扫码支付
钱包余额 0

抵扣说明:

1.余额是钱包充值的虚拟货币,按照1:1的比例进行支付金额的抵扣。
2.余额无法直接购买下载,可以购买VIP、付费专栏及课程。

余额充值