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RSS订阅原创 Burst传输
Burst传输实质就是只发送一次地址，很多传输如AHB总线，发送每个数据都要对应发送其地址。Burst传输就是提高了传输效率，在一次传输过程中，只发送一次地址。只发送一次地址，之后地址自动累加，累加到一定值后地址又自动回到初始地址。数据传输在一段地址范围内，循环传输。只发送一次地址，之后地址自动累加，直到所有数据发送完成。只发送一次地址，之后地址不变，所有数据都是传送到此地址。
2023-05-19 14:27:33
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原创 笔记 AXI_Lite
AXI_Lite 的大致框架与 AXI_FULL 相同，都有五个通道。即有主机向从机发送读写命令，以此为基础理解五个通道，为主从方式进行通讯，
2023-04-16 01:54:37
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原创 vivado 增量编译
增量编译是VIVADO中的一项技术，即Incremental Compile，它是是Vivado提供的一项高阶功能。目的旨在当设计微小的改变时，重用综合和布局布线的结果，缩短编译时间。增量编译的流程如下所示：图片:增量编译需要已经编译完成的原始设计的dcp文件（）作为参考，当我们在原始设计上做微小的改动时，就可以使用增量编译的流程。这些改动包括：RTL代码的微小修改网表的微小修改，比如增加或者改变ILA在Vivado里面，，前提是工程已经实现过一次，已经有之前的网标作为对照参考。
2023-04-13 18:45:35
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原创 【FPGA岗位需求】
本人从事FPGA方面一年多的时间、因工作中的不满萌生了换工作的想法，见市场上对FPGA的需求可谓是五花八门，我以一个小白的身份，对这些需求来了一个,以后整理补充，并简单说明，各位大佬若觉得有误导别人之处，还请指正。有些概念我自己也不清楚，也趁此了解一下，各位小白共勉。（前期可能链接比较多，不利于直接观看，在我总结整理后，会优化）
2023-04-13 00:37:10
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原创 Unable to open archive *** Xilinx_Vivado_SDK_
我在安装vivado的过程中出现这个问题，搜索后没有得到理想的解决办法，于是思考我错在了什么地方，思索之后哦，原来我把安装包放在了中文路径下，我可真是大聪明。如果你也想无脑解决，希望这个是你想要的答案。
2023-04-13 00:02:53
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空空如也
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