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原创 北航人机交互复习

北航人机交互整理,部分由gpt4生成。太多辣复习不完辣

2023-12-27 22:07:25 1963 1

原创 【NNI】在集群上使用NNI显示request报错的解决方案

解决在集群上使用NNI时出现request失败的报错问题

2023-04-18 17:25:47 667 1

原创 【NNI】自动超参搜索

在机器学习中我们时常需要成为调参侠,调模型的各种超参如学习率、dropout。NNI可以自动选择较好的参数,免去了手动调参的过程。

2022-10-24 20:35:05 879

原创 【Unity Mirror】NetworkTeam的使用

最近有一个需求是个人空间的邀请功能:每一个人都可以进入自己的空间进行家具等的装扮,同时可以邀请好友来到自己的空间共同观赏,邀请时两人出现在同一个空间,可以互相看到对方;但在未被邀请的时候,只能进入自己的空间,且看不到别人。因此我就想到了利用NetworkTeam来完成。mirror官网的介绍:团队管理使用玩家对象上的网络团队组件以及需要将其可见性限制在团队中的网络对象,提供了仅对同一团队中的人可见的联网对象。将Network Team组件添加到玩家预制件和属于团队的任何其他预制件。在运行时将同一团队中的玩家

2022-06-21 20:27:22 747

原创 软件工程-个人作业-提问回顾与个人总结

以前提问题的博客A:在实际的测试中,我们的测试也确实产生了可重复、一致的结果。后面在我们的缺陷记录中都是可以复现的,我们也对每一个缺陷进行了修复。A:在我们的团队中有一个专门负责测试的同学,我认为由于在经过团队会议后,所有人对需求的理解应该都是相同的,不存在我之前所想的两个人对功能需求理解不同的情况,因此我认为这个由测试的同学来写也是比较合理,当然,在代码移交给测试的同学前,这个功能已经被写代码的同学测试了很多次了。A:在实际上,我们团队并没有选择该方式进行评价,而是采用了完成任务的个数与质量来评价,因为我

2022-06-21 19:54:45 402

原创 Unity脚本出现missing时的解决方法

在做unity项目时,我们可能会遇上如下所示的脚本丢失问题:这个问题出现在我们软工使用git进行合作开发时,最后经过排查,发现是.meta文件出现了问题,原因是我们的gitignore中不小心加入了*.meta(直接使用了官方的ignore文件没有注意到这个),然后在开发时,pull别人的commit时,meta文件没有解决完冲突就保存到本地了:可以看到这个文件里存了一堆git的冲突信息,因此如果出现了missing的情况,可以先去自己的.meta文件里,看看是否有不恰当的git冲突信息,如果有的话可以

2022-06-11 16:41:03 8398

原创 QQ音乐与网易云音乐评测分析

QQ音乐与网易云音乐评测分析项目内容这个作业属于哪个课程北航 2022 春季敏捷软件工程这个作业属于哪个课程个人作业-软件案例分析我在这个课程的目标是了解并提高自己对软件工程的认识和实践能力,加强软件开发技巧与团队协作能力,收获软件工程实践经验这个作业在哪个具体方面帮助我实现目标通过对具体软件进行分析、评测、思考、总结,理解软件工程在软件产品上的重要性第一部分 调研与评测我选择的是QQ音乐和网易云音乐两款软件,下面对其分别进行调研与评测。QQ音乐测

2022-03-18 13:27:34 11743 1

原创 BUAA 软件工程 第一次作业

BUAA 软件工程2022 第一次作业项目内容这个作业属于哪个课程北航 2022 春季敏捷软件工程这个作业的要求在哪里作业说明链接我在这个课程的目标是了解并提高自己对软件工程的认识和实践能力,加强软件开发技巧与团队协作能力,收获软件工程实践经验这个作业在哪个具体方面帮助我实现目标快速了解现代软件工程,学习团队协作的方式,学习源代码管理的方法以及CI/CD的方法阅读提问Q1:单元测试真的能产生可重复、一致的结果吗单元测试应该产生可重复、一致的结果如

2022-03-09 23:54:31 767 1

原创 python爬虫跳过异常处理

python爬虫跳过异常处理最近需要用爬虫爬一些图片,但是经常遇到报错如下:requests.exceptions.ConnectionError: HTTPConnectionPool(host='www.xxxxxx.com', port=80): Max retries exceeded with url: / (Caused by NewConnectionError('<urllib3.connection.HTTPConnection object at 0x0334D290>:

2021-08-08 11:48:35 4069

原创 【论文笔记001】Multi-modal Multi-relational Feature Aggregation Network for Medical Knowledge Representati

【论文笔记001】Multi-modal Multi-relational Feature Aggregation Network for Medical Knowledge Representation Learning1.简介《Multi-modal Multi-relational Feature Aggregation Network for Medical Knowledge Representation Learning》来源:ACM Multimedia 2020链接:https:/

2021-07-19 15:14:15 663 1

原创 面对对象 第一单元总结

面对对象 第一单元总结设计分析第一次作业总体架构Main类负责读入与输出,将读入的字符串传入方法类Regexfunc中,Regexfunc类专门用于正则表达式的处理,返回该字符串经过解析后的表达式Expression;在Expression中含有一个Polyitem的hashmap,用于保存表达式的每一项;而每一个Polyitem又含有一个Factor,作为项的因子。类的分析度量分析下表是对每一个方法所取的度量分析,除了求导和正则表达式解析两个方法认知复杂度较高外,其他均在一个较低的水平上。

2021-03-26 21:23:38 237

原创 JAVA正则表达式的使用

JAVA正则表达式的使用正则表达式语法最简单的正则表达式就是字符串,比如hello world也是一个正则表达式,匹配"hello world"字符串。在这基础上我们加入其他符号表示,以满足我们匹配一定格式的字符串而不是与正则表达式一模一样的字符串,这些符号可以大致分为[]、{}、(),而其他的一些符号(如.,+,*,\\d等等)其实都可以认为是他们的简写形式。[][]表示匹配一个在[]中包含的任一字符,如[abc]表示匹配a或者b或者c。可以使用-来表示一个字符区间,[a-c]与[abc]是

2021-03-01 23:35:13 2008 5

原创 从零开始的JAVA学习-pre02

从零开始的JAVA学习-pre02task1题目描述构造一个Bookset类,来表示多册书籍构成的一套丛书,要求Bookset类包含属性:书名、单价(单价是指一套丛书中单册书籍的价格)以及含有单册书籍的数量(我们规定丛书中每册书单价相同)。相应的要求完成的程序可以查询丛书的名字、单价、数量以及这套书的总价。 一开始给出一套丛书。7种操作:typeattribute意义输出1/2/3无查询Bookset的名字/单价/数量相应的名字/单价/数量4nameBook

2021-02-23 00:27:30 566 1

原创 使用Verilog搭建一个单周期CPU

使用Verilog搭建一个单周期CPU搭建篇总体结构其实跟使用logisim搭建CPU基本一致,甚至更简单,因为完全可以照着logisim的电路图来写,各个模块和模块间的连接在logisim中非常清楚。唯一改变了的只有GRF和DM要多一个input PC端口,用来display的时候输出PC值;IFU同理多了一个output PC,用来把PC的值传给GRF和DM。其他的模块我都是直接对着logisim原封不动地用Verilog重新实现了一遍。目前支持指令集{addu、subu、ori、lw、sw、be

2020-12-04 12:10:36 2606

原创 使用logisim搭建单周期CPU与添加指令

使用logisim搭建单周期CPU与添加指令搭建总设计借用高老板的图,我们只需要分别做出PC、NPC、IM、RF、EXT、ALU、DM、Controller模块即可,再按图连线,最后进行控制信号的处理,一个CPU就差不多搭完了。目前支持的指令集为{addu、subu、ori、lw、sw、beq、jal、jr、nop、lui、sb、lb、sh、lh}下面分模块逐个分析PC本质上就是一个32位的寄存器,这里采用的是异步复位,所以直接把reset信号连在clear口。NPC由于我的CPU支持b

2020-11-27 11:52:00 16279 5

原创 MIPS小总结

MIPS读入输出字符串输出.ascii与.asciiz.ascii不会在字符串后加上'\0',而.asciiz会在字符串加'\0'。两者均以字节为单位存储数据,这会对我们带来一些小麻烦,.asciiz之后分配的空间首地址有可能无法字对齐,因此我们在定义.ascii与.asciiz时尽量写在最后面#正确写法.data array_int: .space 28 space: .asciiz " "#错误示范.data space: .asciiz " " array_int: .sp

2020-11-12 13:11:44 4084 5

原创 Verilog小总结

Verilog小总结基础assignassign作为一个组合逻辑常用的语句,可认为是将电线连接起来,当然它能做的不仅仅是将一个输入直接输出,它能把输入信号进行逻辑运算后再输出。当assign左右两边位宽不相等时,将自动进行零扩展或截断以匹配左边的位宽。eg:module top_module ( input a, input b, input c, input d, output out, output out_n ); wire w1, w2; // Declare two wi

2020-11-06 22:39:14 1017

原创 Logisim关于Moore型和Mealy型FSM的搭建

Logisim关于Moore型和Mealy型FSM的搭建Moore型与Mealy型的区别根据黑书上所讲,Moore型状态机即为输出只取决于系统的状态,而Mealy型状态机输出取决于当前系统的状态和输入。这样的解释可能难以理解,我们可以这样去区分Moore型与Mealy型:假设现在有输入in、状态S、输出out,对于Moore型:out为关于S而不关于in的一个组合逻辑,即每个S都对应一个out(当然可能多个S的out是一样的,也即out = f(S)),只要当前状态S发生改变,out便随之改变。

2020-10-22 15:29:26 2430 1

空空如也

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