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原创 verilog每日一撕day1:固定优先级与轮询仲裁器

固定优先级仲裁其和轮询仲裁器

2023-04-25 23:05:34 285

原创 risc-v处理器设计

RISC-V CPU设计-绪论及单周期CPU设计绪论第一章:单周期CPU设计①:pc_reg②:IF阶段③:ID阶段③ EX阶段注释也是必不可少的绪论为了更好的学习和理解RISC-V处理器设计,在阅读了计算机组成与设计软硬件接口RISC-V这本书后,我决定自己动手写一个简单的CPU,下面我将分享整个设计的过程,本过程是我个人学习的一个记录,仅供参考,我的代码水平不高,作为一名跨专业考生我只是学习了半年的的verilog,代码质量肯定不是很高,顺便一提,整个CPU基本都是我根据书上的图来搭建的,可能代码

2022-04-21 15:35:57 5159 8

空空如也

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