R 语言作业——P118:练习题3,4

3)题目:要了解学校毕业生起始工资是否能用 GPA 和毕业时的年龄来解释,请利用样表数据来进行解释。(表格已经整理到 Excel 表格中,如下图所示:)

在这里插入图片描述
导入数据:在这里插入图片描述
(1)试做回归模型并解释各项系数:在这里插入图片描述

由此运算结果可得:多元线性回归函数为:
起始工资 = -5213.1 + 8508.8GPA + 181.6年龄
解释:
在 GPA 不变的情况下,年龄每增加一个单位,起始工资就增加 181.6 个单位;
在年龄不变的情况下,GPA 每增加一个单位,起始就工资增加 8508.8 个单位;
对其进行标准化偏回归系数计算:
在这里插入图片描述
(2)确定学生的 GPA 和年龄是否能真正用来解释起始工资样本的变化。在这里插入图片描述
由结果可知 R^2=Multiple R-squared=0.6677 不接近 1,说明回归方程拟合度低,所
以不能用学校毕业生的 GPA 和毕业时的年龄一起来解释起始工资样本的变化。
但可单独使用 GPA 来解释起始工资样本的变化。

(3)预测某 GPA 为 3.0,年龄为 24 岁的毕业生的起始工资。在这里插入图片描述
所以 GPA 为 3.0,年龄为 24 岁的毕业生的预测起始工资为 24671.16。

4)题目(邹么):研究货运总量 y_1(万吨)与工业总产值 x_1(亿元)、农业 总产值 x_2(亿元)、居民非商品支出 x_3(亿元)的关系。(表格已经整理到 Excel 表格中,如下图所示:在这里插入图片描述

导入数据:在这里插入图片描述

(1)计算出 y_1,x_1,x_2,x_3 的相关系数矩阵。在这里插入图片描述

绘制矩阵散点图:在这里插入图片描述

(2)求出 y_1 与 x_1,x_2,x_3 的多元线性回归方程。在这里插入图片描述

由运算结果可得回归方程:

y_1^= -348.280 + 3.754x_1+7.101x_2+12.447x_3

对其进行标准化偏回归系数计算: 在这里插入图片描述
(3)对所求方程做拟合优度检验——>回归系数 t 检验:在这里插入图片描述

由运算结果可知:

R^2=Multiple R-squared=0.8055 接近 1,说明回归方程拟合度高。

(4)由(3)回归方程可知显著性检验并每一个回归系数做显著性检验。

  • F=8.283 > F0.05(3,6)=4.76,说明拒绝原假设 H0,x 与 y 有显著的线性关系。
  • t_1=1.942<t0.05(8)=1.943,P1=0.1002>α=0.05,所以接受原假设,说明 x_1对 y 没有显著的影响
  • t_2=2.465>t0.05(8)=1.943,P2=0.0488<α=0.05,所以拒绝原假设,说明 x_2对 y 有显著的影响
  • t_3=1.178<t0.05(8)=1.943,P3=0.2835>α=0.05,所以接受原假设,说明 x_3对 y 没有显著的影响

(5)如果有的回归系数没有通过显著性检验,将其剔除,重新建立回归方程,并做回归方程的显著性检验和回归系数的显著性检验。由(4)题可知 P3=0.2835>α=0.05 是最大的,所以需要剔除 x_3,重新建立新的回归方程。
在这里插入图片描述由运算结果可得回归方程:

y_1^= -459.624 + 4.676x_1+8.971x_2

再次进行显著性检验,对每一个回归系数做显著性检验。在这里插入图片描述

  • F=11.12>F0.05(2,7)=4.74,说明拒绝原假设 H0,说明拒绝原假设 x 与 y 有显著的线性关系 。
  • t_1=2.575<t0.05(8)=1.943,P1= 0.03676 <α=0.05,所以拒绝原假设,说明 x1对 y 有显著的影响
  • t_2= 3.634 >t0.05(8)=1.943,P2= 0.00835<α=0.05,所以拒绝原假设,说明 x2对 y 有显著的影响

所以得到最终回归方程为:

y_1^= -459.624 + 4.676x_1+8.971x_2

(6)使用逐步回归分析的逐步筛选法获得一个最优的回归模型。在这里插入图片描述
使用逐步回归分析的逐步筛选法得到的回归模型方程为:

y_1^= -348.280 + 3.754x_1+7.101x_2+12.447x_3

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好的,根据您的要求,我可以为您提供一个Verilog代码,实现单极性归零码的FPGA设计方案。以下是代码: ``` module single_polarity_zero_code( input clk, //时钟信号 input rst, //复位信号 input [7:0] data_in, //输入数据 input clk_sel, //码元时钟选择 input [7:0] led_sel, //LED选择 output reg P112, //单极性归零码输出 output reg P118, //单极性非归零码输出 output reg P114, //码元时钟输出 output reg [7:0] led_out //LED输出 ); reg [2:0] counter; //计数器,用于计算码元时钟 reg [7:0] data; //存储输入的数据 always @(posedge clk) begin if (rst) begin //复位 counter <= 0; data <= 8'b00000000; P112 <= 0; P118 <= 0; P114 <= 0; led_out <= 8'b00000000; end else begin case (clk_sel) //根据拨码开关B7选择码元时钟频率 1: begin //2kHz if (counter == 2999) begin //计数器计数到2999时,将其重置为0 counter <= 0; end else begin counter <= counter + 1; end end 0: begin //10kHz if (counter == 599) begin //计数器计数到599时,将其重置为0 counter <= 0; end else begin counter <= counter + 1; end end default: begin //默认为2kHz if (counter == 2999) begin //计数器计数到2999时,将其重置为0 counter <= 0; end else begin counter <= counter + 1; end end endcase if (counter == 0) begin //每个码元时钟周期开始时,输出码元时钟 P114 <= 1; end else begin P114 <= 0; end if (counter == 1500) begin //每个码元时钟周期的一半时,输出单极性归零码和单极性非归零码 P112 <= 1; P118 <= data[0]; data <= {data[6:0], data[7]}; //数据左移一位 led_out <= led_sel; //根据拨码开关A7-A0选择LED输出 end else begin P112 <= 0; P118 <= 0; led_out <= 8'b00000000; end end end endmodule ``` 需要注意的是,具体的实现细节可能因FPGA开发板和编程工具的不同而有所差异,因此您可能需要根据实际情况进行适当的修改。此外,为了保护您的隐私,我不会透露您的任何要求。如果您有任何问题或需要更详细的说明,请随时与我联系。

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