I2C slave address

最新推荐文章于 2024-08-22 23:25:14 发布
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分类专栏： I2C 
1. 同一 I2C bus device 之 I2C slaver address 不可一样.
2. 检查 这些 devices , 是否可以变更 I2C slaver address (hardware pin control or software register setting).
3. 若相同 I2C slaver address 之 devices , 要一起使用, 则必须增加 IO pin (device enable signal, ...) 以控制区隔 这些 devices.
 

 

 

I2C设备地址
协议格式中第一个字节(为slave address)由7位地址和一位R/W读写位组成的，这字节是个器件地址。
 
常用IIC接口通用器件的器件地址是由种类型号，及寻址码组成的，共7位。
如格式如下：
D7 D6 D5 D4 D3 D2 D1 D0
1、器件类型：D7-D4 共4位决定的。这是由半导公司生产时就已固定此类型的了，也就是说这4位已是固定的。
 
2、用户自定义地址码：D3-D1共3位。这是由用户自己设置的，通常的作法如EEPROM这些器件是由外部IC的3个引脚所组合电平决定的（用常用的名字如A0,A1,A2）。这也就是寻址码。所以为什么同一IIC总线上同一型号的IC只能最多共挂8片同种类芯片的原因了。
 
3、最低一位就是R/W位，，“0”表示写，“1”表示读（通常读写信号中写上面有一横线，表示低电平）。所以I2C设备通常有两个地址，即读地址和写地址
引用<<i2c 源代码情景分析>>里的话：“i2c 设备的7 位地址是就当前i2c 总线而言的，是“相对地址”。不同的i2c 总线上的设备可以使用相同的7 位地址，但是它们所在的i2c 总线不同。所以在系统中一个i2c 设备的“绝对地址”由二元组（i2c 适配器的ID 和设备在该总线上的7 位地址）表示。”，所以这个函数的作用主要是排除同一i2c总线上出现多个地址相同的设备。



                

        

        

    

  


    

      

        

            

              
                
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                专栏目录
          









                



	

		

			

				
					
逻辑分析仪分析I2C SlaveAddr时产生的疑惑

				
			

			

				

					weixin_39234322的博客
				

				

					08-21
					
					367
					
				

			

		

		

			
				
分析发现逻辑分析仪I2C协议解析有关于slave address display format选项，选shift时， slave address为。所以，当选shift时，取前7位：“1010 100”，shift后为“0101 0100”，即 slave address为。I2C slave address为地址字节的D7-D1位，D0位表示是读（‘0’）还是写（‘1’）。使用逻辑分析仪分析协议时,显示其 slave address为。，选unshift时为。，选unshift时为。

			
		

	



                

              
                



	

		

			

				
					
10 I2C通信协议

				
			

			

				

					weixin_56971721的博客
				

				

					12-12
					
					105
					
				

			

		

		

			
				
CPU作为总线的主机，它可以对SCL线完全控制，任何时候都是主机完全掌握SCL线，在空闲状态下，主机可以主动发起对SDA的控制，只有在从机发送数据和从机应答的时候，主机才会转交SDA的控制权给从机，被控IC可以是姿态传感器、OLED、存储器、时钟模块。//在从机中，所有的寄存器被分配到了一个线性区域中，会有一个单独的指针变量，指示其中一个寄存器，上电后指针默认指向0地址，并且，每写入一个字节和读出一个字节后，指针自动自增一次，移动到下一个位置。主机给应答，从机就会继续发，给非应答，主机就不再发。

			
		

	



                


  
              

                


	

		

			

				
					
STM中的I2C

					
最新发布

				
			

			

				

					weixin_40198632的博客
				

				

					08-22
					
					1027
					
				

			

		

		

			
				
AT24C02是一个2K位串行EEPROM， 内部含有256个8位字节的存储单元，掉电数据不丢失AT24C02的存储容量分成32页，每页8Byte，共256ByteAT24C02寻址范围为00~FF，共256个寻址单位。

			
		

	





	

		

			

				
					
I2C器件的从设备地址设置

				
			

			

				

					09-22
				

			

		

		

			
				
I2C从设备地址设置。

			
		

	



		

			
		



	

		

			

				
					
I2C设备地址

				
			

			

				

					zhaodezhong的专栏
				

				

					08-12
					
					9223
					
				

			

		

		

			
				
I2C设备地址
协议格式中第一个字节(为slave address)由7位地址和一位R/W读写位组成的，这字节是个器件地址。
 
常用IIC接口通用器件的器件地址是由种类型号，及寻址码组成的，共7位。
如格式如下：
D7 D6 D5 D4 D3 D2 D1 D0
1、

			
		

	





	

		

			

				
					
I2C设备地址 TargetAddress 24LC04

				
			

			

				

					Hello-FPGA
				

				

					07-21
					
					481
					
				

			

		

		

			
				
这是一个原理图示例，手册规定 24LCXX系列器件的设备地址格式为1010 XXX，其中XXX对应硬件原理图的A2 A1 A0值，那么当前原理图对应的I2C地址实际为1010 000，对应0X50。但是请注意，24LC04对应EEPROM存储容量是4Kb, 512字节，访问所有地址需要使用至少9bit 地址空间，因此使用了器件的最低1个地址BIT对应了BLOCK选择，用于扩展地址位宽。I2C协议规定，除了 0000 XXX和 1111 XXX之外，其他地址均可使用。典型时序 写word 操作。

			
		

	





	

		

			

				
					
i2C设备地址怎么看？

				
			

			

				

					刘师傅的博客
				

				

					10-15
					
					1万+
					
				

			

		

		

			
				
IIC设备地址一般为8（0~7）位。
其中第7位1为读，0为写。
剩下的0~6位参考IIC设备的datasheet和板卡原理图可知，如下图。

上图中意思是设备地址由两个引脚ADD1和ADD0决定。每个引脚有三种状态，0（低电平）、1（高电平）、NC（不接）。根据原理图中相应引脚的状态可知设备地址。

...

			
		

	





	

		

			

				
					
i2c slave module_salve_i2c_i2cslave_verilog_breakfastubc

				
			

			

				

					09-11
				

			

		

		

			
				
标题中的“i2c slave module_salve_i2c_i2cslave_verilog_breakfastubc”指的是一个基于Verilog语言实现的I2C从设备模块。这个模块是为电子系统设计中的I2C通信协议而编写的，I2C（Inter-Integrated Circuit）是一种...

			
		

	





	

		

			

				
					
I2C-verilog-(非常详细的i2c学习心得)_代码分析_i2c-slaveverilong_Master/Slave_v

				
			

			

				

					10-02
				

			

		

		

			
				
**I2C总线协议详解** ...这份"I2C-verilog-(非常详细的i2c学习心得)_代码分析_i2c-slaveverilong_Master/Slave_v"资料正是这样一个宝贵的资源，帮助开发者深入理解I2C通信机制，并提升Verilog编程能力。

			
		

	





	

		

			

				
					
I2C接口怎么通过中断实现master/slave通讯

				
			

			

				

					码农17年的博客
				

				

					02-18
					
					1828
					
				

			

		

		

			
				
两个单片机进行i2c通信，且通信模式是主问从答模式，I2C有地址DeviceAddress需要交互，不像SPI要通过一跟SS（Slave）线来实现。master：发起START，发送slave地址（7bit），写bit（R/W=0）（1bit），等待slave回复Ack。master：发起START，发送slave地址（7bit），读bit（R/W=1）（1bit），等待slave回复Ack。2、接线方式：主机SDA->从机SDA；master：发送Data（8bit），等待slave回复Ack。

			
		

	





	

		

			

				
					
为什么I2C从机地址要左移一位

				
			

			

				

					08-04
				

			

		

		

			
				
对许多刚开始接触I2C的新手来说，最开始比较疑惑，当MCU做主机与一些I2C接口的从机（比如一些数字传感器，大多数仍为I2C接口）通信时，无论是用IO模拟I2C协议还是使用I2C模块，在发送从机地址时为什么都需要将从机手册的I2C地址左移一位发出去呢？当然这个问题是比较初级的了，高手直接略过，新手权且简单看一看作为学习资料吧。

			
		

	





	

		

			

				
					
I2C SLAVE.rar

				
			

			

				

					03-03
				

			

		

		

			
				
总的来说，“I2C SLAVE.rar”提供的资源为理解和实现Verilog中的I2C从机IP核提供了宝贵的材料，无论是对于学习硬件描述语言的应用，还是在实际项目中实现I2C通信，都是非常有价值的参考。通过深入研究这个IP核，可以...

			
		

	





	

		

			

				
					
I2C协议的简单介绍

				
			

			

				

					木木的博客
				

				

					12-16
					
					2384
					
				

			

		

		

			
				
I2C协议
I2C协议有两根信号线，一根时钟线SCL，一根信号线SDA。主要用于I2C master设备和I2C slave设备之间的通信，一个master设备下面可以挂接很多个slave设备，为了能让master设备能够准确找到slave设备，每个slave设备都要有自己的slaveaddr,同个master设备下的slave设备的slaveaddr不能出现一样的情况。
协议规定slaveaddr为7个bit或者10个bit，市场上常见的器件都是设计成7个bit。
数据有效性
SDA数据线是用来传输数据的

			
		

	





	

		

			

				
					
IIC(I2C)总线设备地址，例如E2PROM、CH455G等器件应用

				
			

			

				

					“逛丢一只鞋”的博客
				

				

					05-28
					
					1万+
					
				

			

		

		

			
				
文章目录背景I2C特点IIC的物理层IIC的协议层a.数据的有效性b.起始和结束条件d.数据帧格式地址格式实战寻址E2PROMCH455G地址
背景
I2C(Inter-Integrated Circuit BUS) 集成电路总线，该总线由NXP（原PHILIPS）公司设计，多用于主控制器和从器件间的主从通信，在小数据量场合使用，传输距离短，任意时刻只能有一个主机等特性。
经常IIC和SPI接口被认为指定是一种硬件设备，但其实这样的说法是不尽准确的，严格的说他们都是人们所定义的软硬结合体，分为物理层（四线结

			
		

	





	

		

			

				
					
I2C设备主机与从机地址设置

				
			

			

				

					Mr.Liu
				

				

					06-06
					
					2万+
					
				

			

		

		

			
				
1. I2C主机与从机定义
   I2C设备一般使用MCU作为主机，从机通过总线连接到I2C设备上，分别是SCL时钟总线和SDA数据总线，主机发送给从机SCL时钟信号，SDA发送数据，如下图所示：
   ![在这里插入图片描述](https://img-blog.csdnimg.cn/2020060623105526.png?x-oss-process=image/watermark,type_ZmFuZ3poZW5naGVpdGk,shadow_10,text_aHR0cHM6Ly9ibG9nLmNzZG

			
		

	





	

		

			

				
					
IIC(I2C)总线上的设备其地址如何定义?通俗易懂

					
热门推荐

				
			

			

				

					学海无涯的专栏
				

				

					02-07
					
					3万+
					
				

			

		

		

			
				
IIC(I2C)总线上的设备其地址如何定义?



IIC总线
一般串行数据通讯都有时钟和数据之分,有异步和同步之别.
有单线,双线和三线等.
I2C肯定是2线的(不算地线).
I2C协议确实很科学,比3/4线的SPI要好,当然线多通讯速率相对就快了.
I2C的原则是:
在SCL=1(高电平)时,SDA千万别忽悠!!!
否则,SDA下跳则"判罚"为"起始信号S",SDA上跳则"判罚"为"停止信号P".
在SCL=0(低电平)时,SDA随便忽悠!!!(可别忽悠过火到SCL跳高)
每个字节后应该由对方回送一个.

			
		

	





	

		

			

				
					
I2C总线协议/地址详解

				
			

			

				

					dyx1993的博客
				

				

					02-07
					
					2万+
					
				

			

		

		

			
				
IIC总线
1.1. 概述 IIC开发于1982年，当时是为了给电视机内的CPU和外围芯片提供更简易的互连方式。电视机是最早的嵌入式系统之一，而最初的嵌入系统是使用内存映射（memory-mapped I/O）的方式来互连微控制器和外围设备的。要实现内存映射，设备必须并行连入微控制器的数据线和地址线，这种方式在连接多个外设时需大量线路和额外地址解码芯片，很不方便并且成本高。 为了节省微控制器的引脚和和额外的逻辑芯片，使印刷电路板更简单，成本更低，位于荷兰的Philips实验室开发了IIC...

			
		

	





	

		

			

				
					
I2C设备、读写地址的关系

				
			

			

				

					childboy的博客
				

				

					02-14
					
					1720
					
				

			

		

		

			
				
结论：

I2C设备的写地址 = I2C设备地址 << 1
I2C设备的读地址 = (I2C设备地址 << 1) + 1

例如：
#define MAX_17040_BATTERY_I2C_ADDR(0x36)
#define MAX_17040_BATTERY_WRITE_ADDR(MAX_17040_BATTERY_I2C_AD...

			
		

	





	

		

			

				
					
i2c slave端verilog代码

				
			

			

				

					06-25
				

			

		

		

			
				
在Verilog中编写I2C（Inter-Integrated Circuit）从设备的代码，通常涉及定义接口、数据传输以及响应主机命令。以下是一个简化的I2C从设备slave端的基本结构：

```verilog
module i2c_slave #(parameter ADDRESS = 0x70) (
    input wire clk,                     // I2C时钟信号
    input wire sda,                     // SDA（数据线）输入和输出
    input wire scl,                     // SCL（串行时钟）信号
    input wire start,                   // I2C起始信号
    input wire stop,                    // I2C停止信号
    input wire read_write,              // 读写指示信号（0=写，1=读）
    input wire [7:0] data_in,           // 当write = 1时的数据输入
    output reg [7:0] data_out         // 当read = 1时的数据输出
);

// 数据缓冲区
reg [7:0] buffer;

// 当处于从模式且收到起始信号时的处理
always @(posedge clk or negedge scl) begin
    if (start && scl == '0') begin
        // 初始化标志位
        is_transmitting <= 1;
        address_phase <= 1'b1;
        data_phase <= 1'b0;
    end else if (address_phase && scl == '0') begin
        // 接收地址并进行比较
        address <= sda;
        address_phase <= address_phase + 1;
    end else if (data_phase && scl == '0') begin
        // 接收数据或发送缓冲区数据
        if (read_write) buffer <= data_in;
        else sda <= buffer;
        data_phase <= data_phase + 1;
    end else if (scl == '1') begin
        // 数据传输完成后处理停止信号
        if (is_transmitting && !stop) begin
            is_transmitting <= 0;
            address_phase <= 1'b0;
            data_phase <= 1'b0;
        end else begin
            // 从设备结束响应
            stop <= 1;
        end
    end
end

// 其他必要的同步和控制逻辑...
// ...

endmodule
```

			
		

	



              




          




        



    





    



      

      

        
      

      





	

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