modelsim基础知识
shenyaopo123
这个作者很懒,什么都没留下…
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Modelsim 的波形观看方法
1.时序逻辑电路的波形观看方法要点:以时钟上升沿为界限,上升沿前看输入,上升沿后看输出,由输入得到输出。举例:在此时序逻辑电路中,输入信号为if()中的两个变量:time_1s_cnt和time_100s_cnt,二者决定了输出信号time_1s_cnt的变化,在仿真波形中,时钟上升沿前要看“time_1s_cnt和time_100s_cnt”两者的值,其值决定了时钟上升沿后的“time_1s_c...原创 2018-03-16 09:59:22 · 7868 阅读 · 0 评论 -
verilog工程设计中语句
1.verilog工程设计中不用的语句原则:所使用的代码必须能够综合出电路1.initial (设计不用,仿真时使用)2.task,function (设计不用,仿真很少使用)3.for , while , repeat , forever (设计不用,仿真很少使用)4.在设计中,模块内部不能出现X态和Z态,模块内部不能出现三态门5.force,wait,fork(设计不用,仿真很少使用)6.#5...原创 2018-03-16 20:08:07 · 424 阅读 · 0 评论