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原创 Verilog出现错误总结

1错误:Error (10200): Verilog HDL Conditional Statement error at key_led.v(13): cannot match operand(s) in the condition to the corresponding edges in the enclosing event control of the always construct...

2019-11-29 20:02:48 5505

基洛夫飞艇.rar

solidworks画的基洛夫飞艇模型,很好看。能直接打开!

2019-10-10

北京邮电大学810真题 自动控制原理 2018年

北京邮电大学810真题,自动化学院控制科学与控制工程专业,不包含答案

2018-12-08

Anaconda3-5.1.0-Linux-x86_64

Anaconda官网速度慢,搬运过来的。 适用于LINUX 64位平台

2018-03-21

空空如也

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