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RSS订阅原创 Calibre fails to export schematic netlist
Cadence Virtuoso Calibre LVSCalibre fails to export schematic netlistschematic导出netlist失败need to set the netlisting mode first before starting Virtuososetenv CDS_Netlisting_Mode Analogin csh, or:export CDS_Netlisting_Mode=Analogin bash/ks..
2020-11-19 22:01:24
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原创 Excel 将一列数据分成多列
处理数据需要将Excel中的一列数据重新排列成若干列，发现直接用excel操作比较复杂，于是用MATLAB实现，顺便复习MATLAB读取excel数据。程序中仅需要参数clm确定需要分成多少列即可。clc;clear all;filename = 'input.xlsx';readin = xlsread(filename);clm = 2; % seperate how many ...
2020-01-08 15:36:18
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原创 版图注意
1. active ploy 不能打contact2. finger 记得连起来3. MOS管LVS报错，报W, L 错误，比如一个反相器中NMOS本来W=2.5,但现在 W=2.43, 问题可能是因为在NMOS上面的PMOS的N井覆盖到了NMOS上，导致其尺寸发生了微小变化。PMOS的N井一定不能把NMOS给包含进去！！！！！图中NWELL 和NPLUS在0.18中需要距离43...
2019-04-27 13:40:27
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原创 MATLAB裁剪图片
考试报名需要上传照片，但是大小比例有要求，高宽比要求为4:3，用MATLAB来进行裁剪。1. 暴力法原图为护照照片，比例为高1080，宽1626，需要将宽变为810，采用逐个值代替法。注意需要将值变为uint8才可以保存成图片并正确显示，double不可。clear all;clc;a00 = imread('C:\Users\Administrator\Desktop\lk...
2019-03-06 19:45:09
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原创 信号采样与抽取
最近测试一个上古时期的一个pipeline-SAR ADC, 这个ADC设计120MS/s，开始测试时采样速率设置为10M，但是采得的波形一直很奇怪。发现这个ADC在输出级加了一个数字抽取器，通过移位寄存器使其每隔16384个点输出一个，说是可以通过此种方法来消除高频噪声。由于对于这个操作比较怀疑，因此在MATLAB上进行了模拟。理论分析：假如采样频率为10M，那么本身的理论信号带宽为5M。如...
2018-09-13 17:13:28
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原创 PCB遇到问题与技巧
画了个4层ADC测试板，下面是其中遇到的一些问题，和解决的办法。1.4层PCB， 打通孔可以对应中间层？via孔 可以选择两个层，一个net。 pad 可以选择一个层，一个net. 2.复制粘贴是，按左键3.cross select mode 鞭炮对应原理图与版图4. 如果PCB连上线还显示有飞线，那么可能是由于这几个器件用分开的线连的，导致有几条中间的线没有对应在该有的net上，删了变成一条线就...
2018-07-06 16:16:02
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空空如也
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