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Hardware
万个函数千个类
这个作者很懒,什么都没留下…
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Xilinx FPGA手册上的“Logic Cells”究竟是什么?
有人问了,也有人回答了。https://forums.xilinx.com/t5/Spartan-Family-FPGAs-Archived/Definition-of-Logic-cell-and-Configurable-Logic-Blocks/td-p/239668原创 2021-07-30 09:34:04 · 2008 阅读 · 0 评论 -
PCIe及USB传输速度小结
PCIe各标准的速度如下: 版本发布时间原始数据传输带宽有效带宽单个Lane带宽总带宽(x16)PCIe1.x20032.5GT/s2Gbps250MB/s8GB/sPCIe2.x20075.0GT/s4Gbps500MB/s16GB/sPCIe3.020108.0GT/s转载 2015-02-20 17:10:16 · 2093 阅读 · 0 评论 -
按字寻址和按字节寻址问题!
转载说明:最近和“位”打交道多了,研究PCI本地地址I/O寻址空间,看到资料是最大256 Byte,可用8根地址线。当时糊涂,在想2^8=256 啊,怎么和256 Byte搭上了。况且数据线是32位呢。于是网上搜了搜,发现这个讨论帮助蛮大的。特别是7楼和13楼的解答。以下内容为转载:L1:按字寻址和按字节寻址问题!迷茫!!!CPU有2转载 2015-02-20 22:17:17 · 14561 阅读 · 5 评论 -
PCI9054 学习小结
转载自:http://blog.csdn.net/lg2lh/article/details/8042008PS: 已经对原文的笔误做修改。PCI的基本协议这里就不介绍了,因为一般的芯片协议都是集成好的,我只需要大体了解就行,不需要做芯片,我感觉就不需要太了解协议。 这里讲解是基于PLX 的9054(9052)芯片为基础的,本人只是入门,望批评指正。转载 2015-02-20 18:11:45 · 6169 阅读 · 0 评论 -
PCI9054 突发模式数据传输 (burst mode data transfer )
C mode target slave , 之前看PCI9054 datasheet知道这个burst mode ,也看了时序图,但是一直缺乏一个感性的认识。今天网上买的 USB逻辑分析仪到货了,接上去用PLX SDK提供的API函数做了个控制台程序试了试读和写,的确认识了single cycle和burst的实际样子。1,EEPROM里给memory space 0的设置是16位原创 2015-02-27 20:56:49 · 5261 阅读 · 2 评论 -
JTAG 之前OK,但是现在找不到并口,或出现并口但是烧不进的话,试试这个:
X:\altera\91\quartus\bin\bblpt.exe /iX:\altera\91\quartus\bin\bblpt.exe /i原创 2015-03-01 13:14:28 · 1523 阅读 · 0 评论