xbox360 jtag经验分享

本文作者分享了改造一台能刷JTAG的双65游戏机的过程,涉及硬件操作、软件加载、注意事项以及老机器维护心得,建议读者在处理这类项目时谨慎操作。
摘要由CSDN通过智能技术生成

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 前段时间收了一台可以刷jtag的双65机型,一眼看到刀锋ui,所以直接拿下。

到手很曲折,一起买的两台机器都没有显示输出,怀疑可能是hdmi设置问题,观察手柄链接成功了,想着换个显示器试试,考虑到自己本来就没有小的显示器,第二天闲鱼50块钱买了台放在书房专门接360,这样还不和家里人打架。按照群友说的按住y和Rt,果然出现画面了,本来还怀疑hdmi接口烧了,已经买了av线在路上了,这下省事了,特别提醒大家当年的老机器有时候热拔插hdmi会烧坏接口,包括电视和各种输出设备。

到手先拆机,果然,老机器碎了一些卡扣。

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 看情况之前是光驱破的机型,不过我手里也没有光盘,懒得折腾了。

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 拆机过程不多赘述了,用专用工具拆机,厚机拆完直接焊接pico2040,上面是厚机的接线图。

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 读nand,记得插上电源,切记别开机,为了以防万一,开机板拆了。我是懒得折腾,就读了3遍nand,建议有条件的尽量读4遍。

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 读完nand看cb版本,cb是cpu里面的熔断标记符号,一共能熔断80个标志位,不可修改,每次更新官方系统都会顺序熔断,这就是为什么系统版本有要求,一但升上去就再也没有可能jtag了,具体的原理好像和cpu南桥的jtag调试楼还有关系,一但升级,这个调试口就没用了,也就没办法再cpu的错误代码出现之前拦截程序了。jr就能看cb,不符合的直接半路出家改焊接rgh3.0就行。没啥大区别,看我另一个帖子。

 

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创建ecc并且写入ecc。pico自动关机,拔usb。

可以拆掉pico接线了,留着后面用pico直接刷nand也行。我是建议做好绝缘,先不着急拔,万一等会有问题还得焊回去pico。

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 焊接jtag三根线,看图就行。

插电,开机,读cpukey。

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合成固件,这个细节我说一下,合成JTAG固件,点jtag就行,后面的aud和rjtag不用管,具体啥作用得看外网文献。jr功能太强大了,基本上你所有折腾360的程序只需要一个jr就够了。

拷贝upflash.bin到fat32格式u盘根目录,游戏机开机进xell时候插进去,自动升级,66mb的固件,很快搞定,关机。

这时候你再开机,就进正常系统了,也就是新系统,这时候大成功。啥也不用做了装回去就行。网上说的拆r6t3你就别折腾了,那个电阻太小了,难度大,拆了有可能不开机,至于系统升级的问题,安装dl,把官方更新禁止了,以后别瞎折腾啥事没有。

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 我就是拆完不开机了,又给焊回去了,焊了一个小时可能…主要是太小了,吹口气就丢了,趴地上找了半天。

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中间短接了一下试了试,还是不开机,大半夜的给我整破防了。

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 终于焊回去了,我的意见就是,别瞎折腾。

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 装回去,哈哈哈顺手签个名,以后玩腻了卖出去,下一个折腾的就会发现,这是一人一机哈哈哈。

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 欧对了,老机器一定换硅脂,旧的硅脂经过你这样折腾,折腾完肯定出问题(硅脂干了后主板变形会导致cpu和散热中间有空隙,热导不出去,分分钟过热)。你还得拆机一次,不如一次搞定。

703c77fcc2304cf09d5cf93fc9503af7.jpg这显示器用起来有感觉,总结一下,只要不拆r6t3,工作量不大。

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JTAG (Joint Test Action Group) 是一种用于测试和编程电子设备的标准接口。在 Verilog 中,可以使用 JTAG 接口来进行芯片级别的测试和调试。以下是一个简单的 JTAG 模块的 Verilog 代码示例: ``` module jtag ( input jtag_clk, input jtag_rst_n, input jtag_tms, input jtag_tdi, output jtag_tdo ); // JTAG state machine reg [2:0] jtag_state; always @(posedge jtag_clk or negedge jtag_rst_n) begin if (~jtag_rst_n) begin jtag_state <= 3'b000; // Test-Logic-Reset state end else begin case (jtag_state) 3'b000: begin // Test-Logic-Reset state jtag_state <= jtag_tms ? 3'b001 : 3'b000; end 3'b001: begin // Run-Test-Idle state jtag_state <= jtag_tms ? 3'b010 : 3'b001; end 3'b010: begin // Select-DR-Scan state jtag_state <= jtag_tms ? 3'b011 : 3'b010; end 3'b011: begin // Capture-DR state jtag_state <= jtag_tms ? 3'b100 : 3'b011; end 3'b100: begin // Shift-DR state jtag_state <= jtag_tms ? 3'b101 : 3'b100; end 3'b101: begin // Exit1-DR state jtag_state <= jtag_tms ? 3'b110 : 3'b101; end 3'b110: begin // Pause-DR state jtag_state <= jtag_tms ? 3'b111 : 3'b110; end 3'b111: begin // Exit2-DR state jtag_state <= jtag_tms ? 3'b001 : 3'b111; end endcase end end // JTAG shift register reg [7:0] jtag_shift; always @(posedge jtag_clk or negedge jtag_rst_n) begin if (~jtag_rst_n) begin jtag_shift <= 8'h00; end else begin case (jtag_state) 3'b100: begin // Shift-DR state jtag_shift <= {jtag_shift[6:0], jtag_tdi}; end 3'b101: begin // Exit1-DR state jtag_shift <= {jtag_shift[6:0], jtag_tdi}; end 3'b111: begin // Exit2-DR state jtag_shift <= {jtag_shift[6:0], jtag_tdi}; end endcase end end // JTAG output assign jtag_tdo = jtag_shift[7]; endmodule ``` 该模块包含 JTAG 时钟(`jtag_clk`)、复位信号(`jtag_rst_n`)、状态机输入信号(`jtag_tms`)、数据输入信号(`jtag_tdi`)和数据输出信号(`jtag_tdo`)。JTAG 状态机根据输入信号 `jtag_tms` 的值进行状态转移,并将数据输入 `jtag_tdi` 传输到一个 8 位移位寄存器中。最后,数据输出 `jtag_tdo` 从移位寄存器的 MSB 输出。
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