FPGA
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FPGA Verilog实现一个脉冲波形变换
一、波形变换需求二、思路(1)脉冲边沿提取,得到波形的上升沿r_rise和下降沿r_fall(2)将上升沿r_rise延迟一节拍r_r_rise,r_rise更新上一周期的周期和脉宽并清空上一次的脉冲周期计数和脉宽周期计数,r_r_rise启动本次脉冲周期计数和脉宽计数,r_fall结束本次脉宽计数三、代码`timescale 1ns / 1psmodule pulse_transfer( ttl_in ,// mcu ttl input sys_clk ,/原创 2021-01-15 12:43:55 · 3419 阅读 · 4 评论 -
FPGA+NIOS2 Verilog+C 实现一个计算器
用FPGA生成一个32位的MCU软核,生产相应的管脚和资源,在MCU里边用C完成计算器的逻辑和LCD1602、矩阵键盘的编写。一、硬件和开发环境FPGA:EP4CE6E22C8 LCD1206液晶,4X4矩阵键盘。 quartus 13二、具体步骤用quartus 13 新建工程,编写外部液晶和键盘的顶层输入输出管脚。然后在Tools->Qsys 打开内核构建菜单:File->open->kernel 查看编辑好的NIOS内核和相关外设组件(附件中).原创 2021-01-15 11:06:46 · 731 阅读 · 1 评论