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原创 FPGA矩阵键盘(三段式)
矩阵键盘的原理我就不多说了,网上有很多,我就不做详细介绍了(扫描法)。module Array_KeyBoard#(parameter CLK_DIV_200HZ=60000 //定义计数器的计数范围 12M*5ms=60000 每次转换时间为5ms 周期为20ms)(input clk,rst,input [3:0]col, //矩阵按键行接口o
2017-08-08 09:16:09 1357
转载 【FPGA】Verilog状态机设计
状态机是fpga设计中极其重要的一种技巧,掌握状态机的写法可以使fpga的开发事半功倍。下面记录一下状态机的基本知识理论。实例:三种状态机实现代码:[csharp] view plain copy print?// 一段式状态机
2017-08-07 13:36:48 799
原创 FPGA数码管计数功能
module decode(input clk,input rst,output [8:0]seg_led1, //显示位数output [8:0]seg_led2);reg [8:0]seg[9:0]; //9位位宽的寄存器数组parameter div=6000000;reg [23:0]cnt;reg clk_div;reg [3:0]ge;
2017-08-05 16:34:08 1848
转载 FPGA学习网站推荐
1 FPGA官网===========================毫无疑问,FPGA的两大主力厂商的主页不容错过,所有资料都原滋原味,http://www.altera.com.cn/http://www.xilinx.com/,这个也可以由中文的,http://china.xilinx.com/比如,altera的Recommended HDL C
2017-08-04 21:45:44 640
原创 FPGA 时钟分频
硬件说明时钟信号的处理是FPGA的特色之一,因此分频器也是FPGA设计中使用频率非常高的基本设计之一。一般在FPGA中都有集成的锁相环可以实现各种时钟的分频和倍频设计,但是通过语言设计进行时钟分频是最基本的训练,在对时钟要求不高的设计时也能节省锁相环资源。在本实验中我们将实现任意整数的分频器,分频的时钟保持50%占空比。1,偶数分频:偶数倍分频相对简单,比较容易理解。通过计数器计
2017-08-04 21:36:02 37789 3
原创 Lattice Diamond中VerilogHDL按键延时消抖
按键消抖在之前的实验中我们学习了如何用按键作为FPGA的输入控制,在本实验中将学习如何进行按键消抖,用按键完成更多的功能。 硬件说明按键是一种常用的电子开关,电子设计中不可缺少的输入设备。当按下时使开关导通,松开时则开关断开,内部结构是靠金属弹片来实现通断。 按键抖动的原理 抖动的产生 :通常的按键所用的开关为机械弹性开关,当机械触点断开
2017-08-04 21:34:20 4306
空空如也
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