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原创基于VERILOG的数字信道化实现

MATLAB信道化代码移植到FPGA

2025-11-10 10:45:30 906

原创 VIVADO/XILINX的FFT IP核的配置和使用

用MATLAB和VIVADO对XILINX的FFT IP核进行仿真测试

2025-04-10 17:25:09 3803 6

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2024-09-09 10:27:40 675 1

XILINX FFT IP核手册

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2025-11-07

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VIVADO/XILINX的FFT IP核的配置和使用
zc掌声: 实部虚部差异大主要原因还是last与 valid ready时序，必须要在valid与ready有效下写入数据达到fft点数后并且s-data-last信号在写入的最后一个数据拉高一个周期才能保证与matlab仿真的数据一致
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Aal iz well: 请问一下为什么要把我的整数都变成小数去运算，小数运算不是更复杂吗
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ちよぅなら: 我们讨论的是fix16_15格式，即总位宽16位，其中小数部分占15位，符号位占1位，没有整数位（因为整数位宽为0）。在这种表示法中，通常使用二进制补码表示负数。因此，整个16位二进制数被解释为一个二进制补码整数，然后乘以2^{-15}（因为有15位小数）来得到实际值。现在，给定的最小二进制数是：1000000000000000（二进制）。按照二进制补码的规则： - 最高位（符号位）为1，表示负数。 - 负数的补码转换为十进制整数的方法是：将除了符号位之外的所有位取反加1，得到其绝对值，然后加上负号。但这里我们也可以直接计算。在二进制补码中，16位有符号整数的最小值是：-2^{15} = -32768。而二进制1000000000000000正好就是-32768（因为它是16位补码表示中绝对值最大的负数）。因此，这个二进制串作为整数是：-32768。然后，由于小数部分有15位，所以实际值等于整数表示乘以2^{-15}（即除以32768）： value = -32768 * (2^{-15}) = -32768 / 32768 = -1. 所以，它的值就是-1。为什么是这样？因为在这种表示法中，我们实际上是把整数范围[-32768, 32767]映射到[-1, 1-2^{-15}]。注意：32767/32768 = (32768-1)/32768 = 1 - 2^{-15}，即0.999969482421875。所以，最小值1000000000000000（二进制）对应-1。
VIVADO/XILINX的FFT IP核的配置和使用
ちよぅなら: 搞的真细，
VIVADO/XILINX的FFT IP核的配置和使用
sIIvs: 不行，IP核的小数位数是固定的，你设置输入位宽X，IP核会定死小数位数为X-1

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