[笔记]1080P中LVDS由2组转4组

最新推荐文章于 2024-06-24 15:18:41 发布
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原文链接：http://www.cnblogs.com/zlh840/archive/2012/12/24/2830587.html
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1080P中FHD@60HZ功能实现：输入2组LVDS，输出4组LVDS，其对应的频率由74.25MHZ变成37.125MHZ。在进行合并处理时，需要注意跨时钟问题。

一个系统中的所有时钟最好都是通过PLL去产生，不要以为分频就可以得到，其实FPGA最怕的就是多时钟问题，如果没处理好就麻烦了，问题也很难解决。

可以用外部PLL产生LVDS中RX和TX所需的所有时钟。

转载于:https://www.cnblogs.com/zlh840/archive/2012/12/24/2830587.html

weixin_30947043
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