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计算机组成原理_-CPU子系统-模型机CPU-1、2-指令与数据通路.ppt

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3.4 模型机CPU设计(简易的16位CPU)*/39CPU设计步骤拟定指令系统确定总体结构安排时序拟定指令流程和微命令序列。形成控制逻辑格式、寻址方式、指令类型设置寄存器、ALU、数据通路设置画流程图(寄存器传送级)列操作时间表组合逻辑：列逻辑式，形成逻辑电路微程序：按微指令格式编写微程序*/393.4.1 指令系统的设计1.模型机的指令格式指令字长16位，采用寄存器型寻址，指令中给出寄存器号。(主存容量为64K×16位)结合高级语言，考虑CPU应该有哪些基本类型的指令？？*/39双地址指令格式：4 3 3 6操作码 目的Rj 寻址DA 源Ri 寻址SA目的地址源地址单地址指令格式：操作码 目的Rj 寻址DA 未使用15~12 11~9 8~6 5~3 2~0目的地址转移指令格式：15~12 11~9 8~6 5 4 3 2 1 0转移地址转移条件操作码 目的Rj 寻址JA 标志 N′ Z′ V′ C′*/39CPU可编程访问的寄存器：寻址方式 编码 助记符 定义2.寻址方式寄存器寻址R、指令计数器PC、堆栈指针SP、程序状态字PSW000R(R)为操作数寄存器间址001(R)(R)为操作数地址自减型寄存器间址010-(R)-(SP)(R)-1为操作数地址(SP)-1为栈顶地址(表3-4)*/39寻址方式 编码 助记符 定义101(PC)+(R)+d为有效地址(R)为操作数地址，立即/自增型寄存器间址011(R)+访问后(R)+1(SP)+(SP)为栈顶地址，出栈后(SP)+1(PC)为立即数地址，取数后(PC)+1变址/相对寻址X(R)X(PC)(PC)+d为有效地址跳步110SKP跳过下条指令执行*/39操作码 助记符 含义3.目标指令集用于数传、堆栈、I/O操作0000MOV传送0010ADD加0110EOR异或双操作数指令1100COM求反1011SR右移单操作数指令1110JMP/RST转移/返回1111JSR转子(调用子程序)(表3-5)*/390 0 0 0 0 5 4 3 2 1 0转移地址无条件转JMP 寄 寻 方式 N′Z′V′C′0 0 0 0 1 无进位转(C=0)0 0 0 1 0 无溢出转(V=0)0 0 1 0 0 数非零转(Z=0)0 1 0 0 0 数为正转(N=0)1 0 0 0 1 有进位转(C=1)1 0 0 1 0 有溢出转(V=1)1 0 1 0 0 数为零转(Z=1)1 1 0 0 0 数为负转(N=1)条件满足，转向转移地址；否则顺序执行。*/39隐含约定：转子时返回地址压栈保存。15 12 11 9 8 6 5 0子程序入口地址 RST SP (SP)+ JSR 寄 寻 方式 N′Z′V′C′ 5 4 3 2 1 0*/393.4.2 部件与与数据通路1.部件设置 可编程寄存器(16位)通用寄存器：R0(000)、R1(001)R2(010)、R3(011)PC(111) 4 3 2 1 0允许中断的标志位 (可扩展) I N Z V C堆栈指针：SP(100)指令计数器：程序状态字：PSW(101)(1)寄存器*/39暂存器C 非编程寄存器(16位):暂存来自主存的源地址或源数据。暂存器D:暂存来自主存的目的地址或目的数。指令寄存器IR地址寄存器MAR数据寄存器MDR:存放现行指令。实现CPU与主存的接口*/39SN74181 4片SN74182 1片(2) 运算部件设置ALU选择数据来源选择器A选择器B移位器:实现直送、左移、右移、字节交换(16位)*/392.总线与数据通路结构为了使数据传送控制简单、集中，采用以ALU为中心的总线结构。(1)组成包括四个部分：ALU部件；寄存器组；存储器；控制系统；*/39 R0~R3 R0~R3 C D C D SP PC MDR、SP、 PCA移位器BALUR2R0R1 MI/OCB内总线CR3DMARMDR IR PC SPPSWABDB控制逻辑 (2)特点ALU为内部数据传送通路的中心；分立寄存器内总线采用单向数据总线(20位)；I/O请求clock图3-43204C0*/39与系统总线的连接通过MAR、MDR实现。MDR输入输出至DB输出至ALU的B门输出从内总线输入从DB输入(打入)(置入) R0~R3 R0~R3 C D C D SP PC MDR/SP/PCA移位器BALUR2R0R1 MI/OCB内总线CR3DMARMDR IR PC SPPSWABDB控制逻辑 I/O请求clock图3-43C0*/393.各类信息传送途径M(1)指令信息置入DBIR R0~R3 R0~R3 C D C D SP PC MDR/SP/PCA移位器BALUR2R0R1 MI/OCB内总线CR3DMARMDR IR PC SPPSWABDB控制逻辑 I/O请求clock图3-43C0*/391)指令地址2)指令地址加1PC打入AALU移内MARPCAALU移内PCC0打入(2)地址信息 R0~R3 R0~R3 C D C D SP PC MDR SP PCA移位器BALUR2R0R1 MI/OCB内总线CR3DMARMDR IR PC SPPSWABDB控制逻辑 I/O请求clock图3-43C0*/393)转移地址寄存器寻址：R0打入BALU移内PC寄存器间址：R0打入BALU移内MARABMDB置入MDRB移、内PCALU R0~R3 R0~R3 C D C D SP PC MDR SP PCA移位器BALUR2R0R1 MI/OCB内总线CR3DMARMDR IR PC SPPSWABDB控制逻辑 I/O请求clock图3-43C0*/394)操作数地址寄存器间址：R0打入BALU移内MAR R0~R3 R0~R3 C D C D SP PC MDR SP PCA移位器BALUR2R0R1 MI/OCB内总线CR3DMARMDR I。省略部分。-43C0*/39DBDBDMA方式：I/O6)I/OR打入I/OMDR内R0ALU7)I/OMM R0~R3 R0~R3 C D C D SP PC MDR SP PCA移位器BALUR2R0R1 MI/OCB内总线CR3DMARMDR IR PC SPPSWABDB控制逻辑 I/O请求clock图3-43C0*/39思考题：ADD (R2), X(PC)该指令实现按既定寻址方式分别确定加数和被加数，并将结果保存于目的地址指定的单元，请分析其涉及到的信息传送通路。(1)指令信息的传送路径？(2)地址信息的传送路径？(3)数据信息的传送路径？*/393.4.3 指令流程与微命令 R0~R3 R0~R3 C D C D SP PC MDR SP PCA移位器BALUR2R0R1 MI/OCB内总线CR3DMARMDR IR PC SPPSWABDB控制逻辑 I/O请求clock1、数据通路中的微命令*/39(1)通路选择ALU功能：A/B选择器：移位选择：结果分配：R0~3/C/D/SP/CP→AR0~3/C/D/SP/PC/MDR →BS3S2S1S0、M、CI直传DM、左移SL、右移SR、节交换EXCPR0~3 / CPC / CPD / CPSP / CPPC / CPMDR / CPMAR/CPPSW R0~R3 R0~R3 C D C D SP PC MDR SP PCA移位器BALUR2R0R1内总线CR3DMARMDR PC SP图3-43 PSW*/39 MCBMARMDRABDB控制逻辑 I/O请求clockEMARSMDRR WEMDRIRSIR(2)访存操作地址使能 EMAR0: MAR与地址线断开1：MAR输出到地址线数据使能 EMDR0: MDR与数据线断开1：MDR输出到数据线主存读写模式 R/W0/0: 主存禁用0/1：写模式1/0：读模式从数据总线置入：SMDR=1,DB→MDR; SIR=1,DB→IR*/39(3)I/O操作与PSW:时钟信号 CPPSW01: 1 → PSW[4]边沿驱动 iDB[19:16]→PSW[3:0] MCBABDB控制逻辑 I/O请求clockR WPSWST置入信号 ST10: 0 → PSW[4]CPPSWiDB[19:16]自动驱动。*/392、指令流程及微命令根据目标指令集和I/O请求，设计处理流程(1)各指令的公共操作FT：PC+1 PCM IR(2)对应微命令电位型微命令脉冲型微命令M IREMAR,R,SIRPC+1 PCPC A,A+1,DMCPPC其中“A+1” 对应 SM=10010,C0=1(暂不考虑时序信号)*/39操作时间表中各微命令的含义: 控制访存操作的微命令EMAR, R/W, SIR, …(2) 控制CPU内部数据通路操作微命令PCA, S3S2S1S0MC0, DM, CPPC, …(3) 控制时序切换的微命令需要结合控制系统才能表述。*/39(2)传送指令FT0：M IR，1)流程图例1：MOV R0，R1；源数ET0：R1 R0PC MARET1：例2：MOV(R0),(R1)；FT0：M IR，PC+1 PCST0：R1 MARST1：M MDR CDT0：R0 MAR目的地址ET0：C MDRET1：MDR MET2：PC MARPC+1 PC*/39形式地址取源操作数，暂存于C，需5步。PC+1 PCST0：PC MARDT1：M MDR CDT0：C MDR源数ET0：C+R1 MARET1：MDR MET2：PC MARPC+1 PC例3：MOV X(R0),X(R1)；FT0：M IRM MDR CST1：ST2：ST3：ST4：PC MARM MDR D形地PC+1 PCDT2：DT3：D+R0 MAR目的地址取目的地址，暂存于MAR，需4步。源数送存储器，需3步。*/39FT0：M IR2)操作时间表例：MOV (R1)，(SP)+；SP MARM MDR CPC+1 PCCPPCST0：SP+1 SPEMARRSMDRMDR B输出BDMCPCSP AA+1DMCPSPEMARPC AA+1RSIRDMDMCPMAR输出ASP AST1：ST2：*/39ET1：MDR MPC MARET2：EMAR、W(EMDR)DMCPMAR输出APC ADT0：R1 MARDMCPMAR输出AR1 AET0：C MDRC B输出BDMCPMDR*/39(3)双操作数指令取目的数，暂存于D。例：ADD X(R1),(PC)+ ；FT0：M IR，PC+1 PC立即数ST0：PC MARST1：M MDR CST2：PC+1 PCDT0：PC MARDT1：M MDR DDT2：PC+1 PC形式地址DT3：D+R1 MARDT4：M MDR D目的数ET0：C+D MDRET1：MDR MET2：PC MAR*/39(4)单操作数指令FT0：M IR，例：COM -(R0)；DT0：R0-1 R0、MARDT1：M MDR DET0：ET1：MDR MET2：PC MARPC+1 PCD MDR*/39(5)转移-返回指令无条件转移SKPR(R)(R)+按R指示从M取转移地址,修改R。(SP)+X(PC)执行再下条指令。从R取转移地址。按R指示从M取转移地址。从堆栈取返回地址,修改SP。以PC內容为基准转移。(RST)*/39FT0：M IR，例1：JMP R0；SP+1 SP、MARM MDR PCET0：ET1：SP MARET2：R0 PCPC+1 PC例2：RST (SP)+；FT0：M IR，PC+1 PCET0：、MAR例3：JMP X(PC)；FT0：M IR，PC+1 PCET0：PC MARET1：M MDR C位移量ET2：PC+C PC、MAR*/39SP-1 SPMDR MST1：PC MDR在ST形成子程序入口；在ET保存返回地址，并转子程序入口。ST0：、MAR例：JSR(R2)；FT0：M IR，PC+1 PCET0：R2 MARET1：M MDR C子程序入口C PC、MAR返回地址压栈ET2：ET3：无条件转子：R(R)(R)+(SP)+(PC)+入口在R中(5)转子指令入口在M中入口在M堆栈容易被遗漏*/39 关 键 词： cpu 子系统 模型 指令 原理 数据 组成 通路 计算机

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