fpga供电电压偏低会怎样_这里有个方法可以简化FPGA电源系统管理哦~

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现场可编程门阵列(FPGA)的起源可以追溯到20世纪80年代，从可编程逻辑器件(PLD)演变而来。自此之后，FPGA资源、速度和效率都得到快速改善，使FPGA成为广泛的计算和处理应用的首选解决方案，特别是当产量不足以证明专用集成电路(ASIC)的开发成本合理有效时。

FPGA取得快速发展，并广泛用于大规模部署。例如，继2013年试点项目中使用FPGA成功加快Bing搜索引擎的速度之后， Microsoft^® 将配备FPGA的服务器使用范围扩展到云数据中心。

FPGA电源系统要求

FPGA需要几个不同的低压供电轨，每个供电轨都有自己的电压和电流规格，以便为其内核逻辑、I/O电路、辅助逻辑、收发器和存储器供电。这些供电轨可能需要按特定的顺序开启和关闭，以避免损坏FPGA。负载点(POL)稳压器将电路板较高的输入电源电压降低为FPGA所需的多个输入电压。当功率转换效率至关重要时，开关稳压器可用作POL稳压器，而线性稳压器(例如低压差(LDO) 稳压器)则用于噪声敏感型电路，例如PLL和收发器。

典型的电路板输入电压为5 V、12 V、24 V和48 V，FPGA的输入电压范围则为低于1 V至约3 V。对于高输入电压(12 V、24