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RSS订阅原创 Vitis HLS报错（已解决）：@E Simulation failed: SIGSEGV. ERROR
Vitis HLS报错解决：@E Simulation failed: SIGSEGV. ERROR
2022-10-16 15:42:11
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原创 关于Windows vivado综合卡死的问题
在综合一个比较简单的工程时发现，在做了些许改动之后（添加了ila），发现综合长时间卡死在第一步（running synth_design）
2022-06-02 00:07:31
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原创 ultrascale pynq环境下安装tensorflow
尽管zcu111是MPSoc，但是基本结构仍然是ARM+FPGA。最近想在板子上跑CNN，苦于没有教程，因此花了一番功夫，经过多次百度/google和尝试之后终于成功在ARM上配置好了tensorflow，将过程简单记录如下：组件：zcu111 v2.5 image tensorflow 1.10.1step1 烧写旧版pynq镜像由于我需要运行的代码中用到了pynq中的XInk等模块，而最新的pynq v2.7 image已经舍弃该模块，会import失败，因此我选择烧写v2.5版本，下载
2022-01-29 18:53:01
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空空如也
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