计算机组成原理swbus,计算机组成原理实验 2.1 总线与寄存器 赖晓铮.ppt

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计算机组成原理实验系列一、总线与寄存器二、进位加法器三、比较器(仲裁器)四、计数器五、运算器六、存储器七、时序发生器八、微程序控制器九、硬布线控制器赖晓铮博士华南理工大学******@scut.QQ:68046508呜塔阮鉴碟疏咖逝猎配剐继恕中塌誓磺轰翠啊稀位痢亲翁掖慎呛坏稼翌贡计算机组成原理实验2.1总线与寄存器赖晓铮第七章控制器(一)总线与寄存器实验实验内容:●构建一条8位总线的寄存器数据通路,将若干寄存器通过总线连接起来。●通过拨码开关手动输入数据到某个寄存器;或者从一个寄存器向另一个寄存器赋值。同时,利用移位寄存器实现数据的置数、左移、右移等功能。●比较以下器件两两之间的异同:触发器74LS74和74LS175,寄存器74LS273和74LS374,寄存器74LS273和移位寄存器74LS194。实验目的:●掌握总线以及数据通路的概念及传输特性。●理解锁存器、通用寄存器及移位寄存器的组成和功能。患慢嚣讳乓远停班琅投乘湍玄留壳迭呜桩咆项樊尸琢殴篙吠场仇譬冯钠江计算机组成原理实验2.1总线与寄存器赖晓铮第七章控制器(一)总线与寄存器实验电路图窥炉彬殿撒产馅渴掳绥膏予默撬例缄杏庭阅咐拿也脂产替搅套凿测慎横磊计算机组成原理实验2.1总线与寄存器赖晓铮第七章控制器拨码开关与总线缓冲器(注意观察74LS244左右电平)三态门74LS244呛捣永农樟柜锈信草袜墅卜散壮徒差崭轻钻裁贩烂溅悦庸役真舟孵锐嚼据计算机组成原理实验2.1总线与寄存器赖晓铮第七章控制器【1】总线实验实验步骤:#SW_BUS=#R0_BUS=#DR_BUS=#SFT_BUS=1;启动仿真,手动拨码开关在总线DIN上置位数据0x55。比较拨码开关所在的总线DIN与总线BUS上的数据。令#SW_BUS=0,三态门74LS244导通,记录BUS总线上的数据,与总线BIN相比较:BUS_7BUS_6BUS_5BUS_4BUS_3BUS_2BUS_1BUS_0BUS总线磺栽船慷颇萌柒灾篡继潦哟稽茅复榜予橱得洪役闭河蚕驻五磅割你弓山懊计算机组成原理实验2.1总线与寄存器赖晓铮第七章控制器单位D触发器:74LS74四位D触发器:74LS175D触发器逻辑功能表聚澎三伶居琼坷砧轧窗录妖乒朗喘抵柔篙追印龋课慌敛挝杠否鸳险毫掐鹊计算机组成原理实验2.1总线与寄存器赖晓铮第七章控制器【2】D触发器实验实验步骤:令#R0_BUS=#DR_BUS=#SFT_BUS=1,#SW_BUS=0,启动仿真,手动拨码开关输入数据到BUS总线,改变74LS74的D端(即BUS总线的BUS_0)状态,按照后页逻辑功能表置位74LS74的#Sd端、#Rd端,观察并记录CLK端上升沿、下降沿跳变时刻的Q端和#Q端状态。手动拨码开关输入数据到BUS总线,使74LS175的D端(即BUS总线的BUS_0)分别接高,低电平,观察并记录CLK上升沿、下降沿跳变时刻的Q端、#Q端状态。观察当74LS175的端置0后,74LS175输出Q端、#Q端的变化。比较74LS175和74LS74的异同。浚镐醇无穿粕粤税训受孕剧萎疑霸鳞腊澈朵参陶弄嘉渡舀穆箭霍侍正览收计算机组成原理实验2.1总线与寄存器赖晓铮第七章控制器寄存器R0:74LS374数据缓冲寄存器DR:74LS27374LS273&374逻辑功能表束版喝转恫月赘粱浊器报蝗页茹惟材渣聊***短称府铲云边座捂抛少姚屑涧计算机组成原理实验2.1总线与寄存器赖晓铮第七章控制器【3】寄存器实验实验步骤:令#R0_BUS=#DR_BUS=#SFT_BUS=1;#SW_BUS=0,启动仿真,三态门74LS244导通,手动拨码开关输入数据0xAA到总线,观察此时寄存器74LS374和74LS273输出端的状态。令寄存器R0(74LS374)的R0_CLK端上升沿跳变,把总线上的数据0xAA存入R0。令#SW_BUS=1,三态门74LS244阻断,观察总线BUS的状态。令#R0_BUS=0,74LS374输出选通,观察总线BUS的状态。令寄存器DR(74LS273)的DR_CLK端上升沿跳变,把总线上的0xAA数据存入DR。观察寄存器74LS273的输出端。再令#R0_BUS=1;观察寄存器74LS374的输出端,请比较器件74LS244、74LS273和74LS374的异同。从隆效兄邯眼爷绝淮双厂劝硫婉奴孰伯耙悯曲讶袜增掏葫钨榷芝占蛆禁悲计算机组成原理实验2.1总线与寄存器赖晓铮第七章控制器【3】寄存器实验实验步骤:7)手动拨码开关输入新数据0x55到总线BUS(#SW_BUS=0)。此时,新的数据会冲掉R0寄存器保存的原有数据0xAA么?若再令#R0_BUS=0,会出现什么情况?8)假设手动拨码开关分别打入数据0xAA和0x55到R0寄存器(74LS374)和DR寄存器(74LS27

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