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SV & UVM
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大收藏家
这个作者很懒,什么都没留下…
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PWM模块原理及简单的设计思路
PWM模块原理及简单的设计思路1. 什么是PWM信号PWM可以算是数字电路中的“独臂”神通,“独臂” - 只需一根线;“神通” - 在很多关键的应用中起到栋梁的作用。PWM(脉宽调制 Pulse Width Modulation)从字面意思上讲它是一种“调制”方式,调制就意味着在某些载波信号上携带了某些的信息,通过解调的过程就可以得到其携带的信息,这些信息的属性由PWM的产生端定义,总之在这一根仅仅发生0、1交替变化的信号线上可以做出很多文章。2. 芯片的PWM引脚输出的波形可能是下面这样3原创 2021-10-09 21:15:23 · 10920 阅读 · 5 评论 -
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1. main_phase 是什么?main_phase是与run_phase并行的12个小的phase中的一个phase,也是一个可以耗时的phase。在UVM验证平台中,只要一个类使用了uvm_component_utils注册且此类被实例化了,那么这个类的main_phase就会自动被调用。2. 通过 start()函数进行挂载以下代码为UVM实战第44页代码task my_env::main_phase(uvm_phase phase); my_sequence seq; phase.r原创 2021-09-01 19:12:41 · 1944 阅读 · 1 评论 -
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UVM常用函数 uvm_top.print_topology()& factory.print()&1 uvm_top.print_topology;要打印验证环境的结构,需要在验证环境构建之后打印,可以在final_phase中打印。virtual function void final_phase(uvm_phase phase); super,finial_phase(phase); uvm_top.print_topology(); factory.print();e原创 2021-09-01 15:25:35 · 4726 阅读 · 0 评论 -
uvm_config_db使用方法总结
uvm_config_db使用方法总结声明:本文参考gsithxy的文章1. uvm_config_db get and setuvm_config_db::set and uvm_config_db::get methods are used to store and retrieve the information from the database respectively.1.1 uvm config db set methodvoid uvm_config_db#(type T = in原创 2021-08-31 21:36:22 · 885 阅读 · 0 评论