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RSS订阅转载 svlib-第一到四章(关于svlib介绍和集成)
svlib是目前的一个关于systemverilog的开源库，里面有一些常用的验证工程师需要用到的操作，比如string，cfg_file，正则表达式等。这里是第一-四章的翻译。
2023-09-15 17:49:34
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原创 SVLIB-utilities for enumeration types
svlib中的EnumUtils类是用于对ENUM类型及其值操作的class，该类需要针对需要操作的ENUM进行参数化。使用EnumUtils必须使用代码中真实定义的ENUM类参数化，不能使用默认定义的int，否则会出现很多莫名的错误。
2023-09-15 17:38:01
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原创 SVLIB-utility macros
两个foreach宏使用时，不能在foreach语句后面加上；，否则接下来的语句是不在这个foreach范围内的。foreach_enum有两种用法，具体如下：主要是将enum的各个定义的值不加条件或者加一些条件的打印出来。foreach_line主要是用于将给定的file一行一行打印出来。
2023-09-15 17:12:28
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原创 Svlib-configuration files
cfg_file的解析和生成对于芯片验证工作来说是非常重要也非常常见的，svlib提供了这样的一个可以解析和生成cfg_file的功能，目前支持解析和生成ini格式的文件内容，yaml格式的文件内容暂不支持解析和生成。不了解ini和yaml文件格式的可以看以下博文，这里不加赘述。
2023-09-14 17:18:41
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原创 svlib-operating system querie
和文件属性查询一样，svlib没有专用的class用来操作系统查询，提供的都是package级别function，直接通过function名调用。
2023-09-12 20:08:55
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原创 Systemverilog中static、automatic在常用块中作用详解
static/automatic在systemverilog中的使用及区别
2023-09-11 15:27:25
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原创 systemverilog中的package及import、`include
systemverilog中的package出现以及涉及的import和include的区别。
2023-09-10 22:11:11
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空空如也
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