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RSS订阅原创 RISC-V 指令系统
指令集从本质上可以分为复杂指令集（Complex Instruction Set Computing，CISC）和精简指令集（Reduced Instruction Set Computing，RISC）两种。复杂指令集的特点是能够在一条指令内完成很多事情。指令架构（Instruction Set Architecture, 缩写为ISA），是软件和硬件的接口，不同的应用需求，会有不同的指令架构。RISC-V指令集使用模块化的方式进行组织，每一个模块使用一个英文字母来表示。
2024-07-09 13:11:22
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原创 RTL设计指导原则
面积：设计所消耗的目标器件的硬件资源数量或者ASIC芯片的面积。FPGA：所消耗的触发器(FF）和查找表（LUT)数量来衡量;ASIC：设计的面积、门数等衡量。速度：设计在芯片上稳定运行时所能够达到的最高频率。
2024-04-14 16:38:50
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原创 RTL书写与延迟、面积、功耗、布线
将case中延迟最大的数据支路，放到最后一级MUX中作为一个输入信号。提取延迟信号所在分支的执行条件，作为最后一级选择器的选择信号。对if else和case中的其他支路条件进行提取，作为最后一级选择器的选择信号。
2024-04-10 13:59:39
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原创 VerilogHDL可综合描述
牢记并理解可综合“四大法宝”所对应的硬件结构。写前，确认电路指标是什么：性能？面积？根据指标再来设计电路。硬件思维方式，代码不再是一行行的代码而是一块一块的硬件模块；对所需实现的硬件电路“胸有成竹”。芯动力——硬件加速设计方法Verilog HDL可综合描述（高质量Verilog书写）单/多if与case条件分支语句从底层结构开始学习FPGA----MUX多路选择器（Multiplexer）数字电路基础：关于锁存器latch。
2024-04-07 14:14:53
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空空如也
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