郭郭的柳柳在学FPGA-CSDN博客

每个工程师的代码风格各不一样，当工程较大，面临需要多个工程师共同完成，或者面临当工程师离职后代码交接等问题。若代码规范未统一，阅读代码将是非常吃力的。下文是作者从各大论坛、网站、书籍收集整理的Verilog编程规范。1．端口定义按照功能块划分，每个功能块中按照输入、输出、双向的顺序，各个功能块之间要有空行或注释为间隔；2．每行声明一个端口并有注释，注释在同一行；3．用下述顺序声明端口，不同类型的端口声明使用一个空行间隔；

2023-10-24 09:51:41 839

原创 Modelsim与Vivado联合仿真报错误：“Failed to open data file “....dat“ in read mode”

Modelsim与Vivado联合仿真报错误：“Failed to open data file "....dat" in read mode”

2023-07-06 11:49:56 2156 2

原创 LVDS学习笔记之lvds_transceiver设计及仿真

本文进行了lvds收发器的设计，并对lvds的设计提出自己的见解。

2022-08-21 15:08:28 4037 5

原创 LVDS学习笔记之 TX模块设计

LVDS TX模块设计及仿真

2022-08-17 00:12:56 2706 2

原创 sdk烧写flash报error:given target do not exis处理方式

问题如图所示1.关闭hw_server服务。打开任务管理器，在进程中找到hw_server并结束进程；2.重新启动hw_server服务。插拔jtag，打开vivado重新Open target并Auto Connect。3.然后就可以使用sdk烧写程序了。

2022-04-15 13:49:39 5047 6

原创 Xilinx OSERDESE2应用笔记及仿真实操

LVDS学习之OSERDESE2应用笔记及仿真实操

2022-01-18 00:02:05 2706 4

原创 Xilinx LVDS接收模块及自动训练设计仿真实操

LVDS接收模块学习教程，包含了训练的思想及程序源码

2021-12-30 23:49:50 10067 28

原创 Xilinx ISERDESE2应用笔记及仿真实操

本文叙述了ISERDESE2的原语，并通过仿真验证了Bitslip功能。

2021-12-21 17:40:58 24040 49

原创 CSDN创作时的一些小技巧

CSDN创作时技巧，持续更新。

2021-12-20 11:05:32 291

原创 Xilinx IDELAYE2应用笔记及仿真实操

本文通过原理加仿真的形式详细的阐明了IDELAYE2的使用，为后续学习LVDS等高速总线接口打下基础。

2021-12-19 23:40:09 21572 13

原创 modelsim之inout类型tb文件编写及仿真

modelsim之inout类型tb文件编写及仿真

2021-12-14 16:23:35 4205

原创 ISE 工具下Flash芯片找不到时如何下载mcs文件

1.前言为了让FPGA上电就能启动程序，往往在设计FPGA外围电路时都会配置一个掉电不丢失的Flash芯片，用于存储程序。但各种系列的FPGA所支持的Flash芯片信号又很有限，用常规的方式无法将mcs文件固化到Flash芯片中。本文首先介绍Xilinx 6/7系列FPGA所支持的Flash型号，在ISE工具下介绍如何固化未支持的Flash型号(以S25FL064L为例)。2.6/7系列FPGA支持的Flash芯片型号Flash有SPI、BPI等，常用的芯片型号为SPI，下表为7系列FPGA支持的SP

2021-11-22 22:42:39 2344

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