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原创 【Verilog学习笔记】D触发器(门级和行为级)+4位寄存器+一个完整的激励程序
【Verilog学习笔记】D触发器(门级和行为级)+4位寄存器+一个完整的激励程序。
2022-07-21 20:00:59 2192
原创 基于74LS161实现的多功能数字钟
1、 利用74LS161芯片将各引脚正确连接实现计数功能,并将输出连接在DCD_HEX显像管上予以显示。2、 利用两片74LS161芯片实现60进制和24进制并实现进位和进位后的清零功能。图2 60进制的实现图3 24进制的实现3、 将分别用于显示时、分、秒的六个74LS161芯片依次连接(用与非门产生的进位信号与下一个芯片的时钟信号相连),将信号源频率调至1HZ就可以实现计时功...
2020-01-03 22:39:22 28356 11
空空如也
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