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原创 状态机与序列检测

序列检测,状态机,Verilog

2023-01-09 10:13:10 331

原创 vivado进行纯block design slice资源不够(慢慢更新)

vivado资源的优化,后面会慢慢更新其他优化方式

2022-03-21 19:36:27 1663 1

原创 ZYNQ的vitis固化程序(含只有PL端代码)慢慢更新吧

1、创建镜像文件2、依顺序放入fsbl的elf文件,bit流文件,cpu0的elf文件,cpu1的elf文件(顺序不能变)SD卡将生成的boot.bin放入SD卡,名字一定不能改生成boot.bin的同时还会生成一个.bif文件,这是路径文件,可以通过Flash只有PL端代码...

2022-03-10 20:02:12 3466

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