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原创 16路并行输入4096点FFT的FPGA实现

将M*N点的傅立叶变换转化为N组M点的FFT和M组N点的FFT，中间是一个额外的旋转运算。采用Beiley‘s 4 step架构并结合低延时方案，初步的设计显示，16路并行输入4096点FFT，工作时钟频率200MHz，数据吞吐率3.2Gsps，latency为1.4us。

原创 几个FFT的公式(4):利用1个N点复数FFT,计算2个N点实数FFT

原创 几个FFT的公式(3):利用2个N点实数FFT,计算N点复数FFT

这个公式看起来有点复杂，是因为N点实数FFT的结果只计算了N/2点，而不是N点。

原创 几个FFT的公式(2):利用N点复数FFT,计算2N点实数FFT

原创 几个FFT的公式(1):利用两个N点FFT,计算2N点FFT

最近因为开发了32768点高速傅立叶变换的FPGA FFT，有人问如何实现65536点FFT.一是可以单独设计，二是可以利用现有的32768点来实现，也就是下面的公式。