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RSS订阅原创 OpenHarmony 6.29计算机工程实践学习日志
GPIO（全称General-purpose input/output）即通用型输入输出。它是芯片上一根能完成多种功能的管脚，用户可以通过GPIO口和硬件进行数据交互（如UART），控制硬件工作（如LED，蜂鸣器等），读取硬件的工作状态信号（如中断信号）等。通常，GPIO控制器通过分组的方式管理所有GPIO管脚，每组GPIO有一个或多个寄存器与之关联，通过读写寄存器完成对GPIO管脚的操作。设置管脚方向： 方向可以是输入或者输出（暂不支持高阻态）；读写管脚电平值： 电平值可以是低电平或高电平；
2023-06-30 21:00:00
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原创 OpenHarmony 6.28 计算机工程实践学习日志
本实验将演示如何在启航KP_IOT主控板上进行互斥锁试验。本次实验主要是进行互斥锁进行试验，通过调用创建、等待和释放互斥锁的三个函数：hi_u32 hi_mux_create(hi_u32 * mux_id)、hi_u32 hi_mux_pend( hi_u32 mux_id, hi_u32 timeout_ms )、hi_u32 hi_mux_post( hi_u32 mux_id)，让两个优先级不同的进程分别申请和释放锁，验证了互斥锁对共享资源的保护功能。
2023-06-29 21:51:43
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原创 实验九 单周期MIPS CPU设计实验（基于Logisim）
一般建议本地的 jar 文件和 cpu.circ 文件在同一目录下，如果出现这个问题，可以调整将本地 cs3410.jar 先移动到 cpu.circ 同目录下后，打开 cpu.circ，logisim 会提示找不到 cs3410.jar，重新指向同目录 cs3410.jar，存盘退出，再重新上传电路文本内容，即可解决这个问题。数据通路、单周期MIPS CPU 硬布线控制器指令译码逻辑、单周期MIPS CPU硬布线控制器ALU控制逻辑、单周期MIPS CPU 硬布线控制器控制信号逻辑。
2023-04-26 14:15:00
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原创 实验三 原码一位乘法实验（基于Logisim）
学生掌握原码一位乘法运算的基本原理，熟练掌握 Logisim 寄存器电路的使用，能在 Logisim 平台中设计实现一个 8*8 位的无符号数乘法器。
2023-04-22 00:30:00
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原创 实验八 4路组相连Cache实验（基于Logisim）
学生掌握cache实现的三个关键技术：数据查找，地址映射，替换算法，熟悉译码器，多路选择器，寄存器的使用，能根据不同的映射策略在Logisim平台中用数字逻辑电路实现cache机制。
2023-04-21 01:30:00
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原创 基于SSM的银行业务系统
本项目采用Spring+SpringMVC+Mybatis框架实现了一个支持用户登录、转账、存款、取款的银行简易业务系统。
2023-04-20 18:43:22
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原创 实验七 MIPS RAM设计（基于Logisim）
学生理解主存地址基本概念，理解存储位扩展基本思想，并能利用相关原理构建能同时支持字节、半字、字访问的存储子系统。Logisim 中 RAM 组件只能提供固定的地址位宽，数据输出也只能提供固定的数据位宽，访问时无法同时支持字节/半字/字三种访问模式，实验要求利用 4 个4 K*8 位的 RAM 组件进行扩展，设计完成既能按照 8 位、也能按 16 位、也能按照 32 位进行读写访问的 32 位存储器，最终存储器引脚定义如下图。
2023-04-20 18:41:24
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原创 实验六 MIPS运算器设计 （基于logisim）
一、设计要求利用前面实验封装好的 32 位加法器以及 logisim 平台中现有运算部件构建一个 32 位算术逻辑运算单元（禁用 Logisim 系统自带的加法器，减法器），可支持算术加、减、乘、除，逻辑与、或、非、异或运算、逻辑左移、逻辑右移、算术右移运算，支持常用程序状态标志（有符号溢出 OF 、无符号溢出 UOF ，结果相等 Equal ），ALU 功能以及输入输出引脚见后表，在主电路中详细测试自己封装的 ALU ，并分析该运算器的优缺点。二、设计目的掌握定点数加减法溢出检测方法理解算术逻辑
2022-05-08 02:42:39
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原创 实验五 汉字字库实验（Logisim）
1、实验目的理解存储系统进行位扩展、字扩展的基本原理，能利用相关原理解决实验中汉字字库的存储扩展问题，并能够使用正确的字库数据填充。2、实验内容现有如下 ROM 组件，4 片 4K32 位 ROM ，7 片 16K32 位 ROM，请在 Logisim 平台构建 GB2312 汉字编码的 1616 点阵汉字字库，电路输入为汉字区号和位号，电路输出为 8×32 位（ 1616=256 位点阵信息），待完成的字库电路输入输出引脚见后图，具体参见工程文件中的 storage.circ 文件，图中左侧是输入引
2022-04-25 08:56:00
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5
空空如也
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